參數(shù)資料
型號： MC9S12C32CFUE16
廠商： Freescale Semiconductor
文件頁數(shù)： 225/690頁
文件大小： 0K
描述： IC MCU 32K FLASH 16MHZ 80-QFP
標(biāo)準(zhǔn)包裝： 84
系列： HCS12
核心處理器： HCS12
芯體尺寸： 16-位
速度： 16MHz
連通性： CAN，EBI/EMI，SCI，SPI
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 60
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2.35 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 80-QFP
包裝： 托盤
產(chǎn)品目錄頁面： 731 (CN2011-ZH PDF)
配用： CML12C32SLK-ND - KIT STUDENT LEARNING 16BIT HCS12
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Chapter 10 Freescale’s Scalable Controller Area Network (S12MSCANV2)
300
MC9S12C-Family / MC9S12GC-Family
Freescale Semiconductor
Rev 01.24
Table 10-9. CANRFLG Register Field Descriptions
Field
Description
7
WUPIF
Wake-Up Interrupt Flag — If the MSCAN detects CAN bus activity while in sleep mode (see Section 10.4.5.4,
(CANCTL0)”), the module will set WUPIF. If not masked, a wake-up interrupt is pending while this ag is set.
0
No wake-up activity observed while in sleep mode
1
MSCAN detected activity on the CAN bus and requested wake-up
6
CSCIF
CAN Status Change Interrupt Flag — This ag is set when the MSCAN changes its current CAN bus status
due to the actual value of the transmit error counter (TEC) and the receive error counter (REC). An additional 4-
bit (RSTAT[1:0], TSTAT[1:0]) status register, which is split into separate sections for TEC/REC, informs the system
If not masked, an error interrupt is pending while this ag is set. CSCIF provides a blocking interrupt. That
guarantees that the receiver/transmitter status bits (RSTAT/TSTAT) are only updated when no CAN status change
interrupt is pending. If the TECs/RECs change their current value after the CSCIF is asserted, which would cause
an additional state change in the RSTAT/TSTAT bits, these bits keep their status until the current CSCIF interrupt
is cleared again.
0
No change in CAN bus status occurred since last interrupt
1
MSCAN changed current CAN bus status
5:4
RSTAT[1:0]
Receiver Status Bits — The values of the error counters control the actual CAN bus status of the MSCAN. As
soon as the status change interrupt ag (CSCIF) is set, these bits indicate the appropriate receiver related CAN
bus status of the MSCAN. The coding for the bits RSTAT1, RSTAT0 is:
00
RxOK: 0
≤ receive error counter ≤ 96
01
RxWRN: 96
< receive error counter ≤ 127
10
RxERR: 127
< receive error counter
11
Bus-off(1): transmit error counter
> 255
1. Redundant Information for the most critical CAN bus status which is “bus-off”. This only occurs if the Tx error counter exceeds
a number of 255 errors. Bus-off affects the receiver state. As soon as the transmitter leaves its bus-off state the receiver state
skips to RxOK too. Refer also to TSTAT[1:0] coding in this register.
3:2
TSTAT[1:0]
Transmitter Status Bits — The values of the error counters control the actual CAN bus status of the MSCAN.
As soon as the status change interrupt ag (CSCIF) is set, these bits indicate the appropriate transmitter related
CAN bus status of the MSCAN. The coding for the bits TSTAT1, TSTAT0 is:
00
TxOK: 0
≤ transmit error counter ≤ 96
01
TxWRN: 96
< transmit error counter ≤ 127
10
TxERR: 127
< transmit error counter ≤ 255
11
Bus-Off: transmit error counter
> 255
1
OVRIF
Overrun Interrupt Flag — This ag is set when a data overrun condition occurs. If not masked, an error interrupt
is pending while this ag is set.
0
No data overrun condition
1
A data overrun detected
0
RXF(2)
2. To ensure data integrity, do not read the receive buffer registers while the RXF ag is cleared. For MCUs with dual CPUs,
reading the receive buffer registers while the RXF ag is cleared may result in a CPU fault condition.
Receive Buffer Full Flag — RXF is set by the MSCAN when a new message is shifted in the receiver FIFO. This
ag indicates whether the shifted buffer is loaded with a correctly received message (matching identier,
matching cyclic redundancy code (CRC) and no other errors detected). After the CPU has read that message
from the RxFG buffer in the receiver FIFO, the RXF ag must be cleared to release the buffer. A set RXF ag
prohibits the shifting of the next FIFO entry into the foreground buffer (RxFG). If not masked, a receive interrupt
is pending while this ag is set.
0
No new message available within the RxFG
1
The receiver FIFO is not empty. A new message is available in the RxFG
相關(guān)PDF資料
PDF描述
GMP.3K.085.EANZ RUBBER BOOT
PSS.F2.BA2.LCT10 CONTACT FO 125UM
FFS.F2.BA2.LCT10 CONTACT FO 125UM
FFS.F2.BB2.LCE30 CONTACT FO 126UM
6348522-1 FOAC 0.5 DPLX CLIP SC CONN BLACK
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MC9S12C32CFUE25 功能描述:16位微控制器 - MCU GOLDFISH RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
MC9S12C32CPB16 制造商:FREESCALE-SEMI 功能描述:
MC9S12C32CPBE25 功能描述:16位微控制器 - MCU GOLDFISH RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
MC9S12C32MFA25 制造商:Freescale Semiconductor 功能描述:MCU 16BIT HCS12 CISC 32KB FLASH 2.5V/5V 48LQFP - Trays
MC9S12C32MFAE16 功能描述:16位微控制器 - MCU GOLDFISH RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
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