參數(shù)資料
型號(hào)： MC9S12C32CFUE25
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 640/690頁(yè)
文件大?。?/td> 0K
描述： IC MCU 32K FLASH 25MHZ 80-QFP
標(biāo)準(zhǔn)包裝： 84
系列： HCS12
核心處理器： HCS12
芯體尺寸： 16-位
速度： 25MHz
連通性： CAN，EBI/EMI，SCI，SPI
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 60
程序存儲(chǔ)器容量： 32KB（32K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2.35 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 80-QFP
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 731 (CN2011-ZH PDF)
配用： CML12C32SLK-ND - KIT STUDENT LEARNING 16BIT HCS12
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Appendix A Electrical Characteristics
Freescale Semiconductor
MC9S12C-Family / MC9S12GC-Family
675
Rev 01.24
In Table A-21 the timing characteristics for master mode are listed.
A.6.2
Slave Mode
In Figure A-8 the timing diagram for slave mode with transmission format CPHA=0 is depicted.
Figure A-8. SPI Slave Timing (CPHA=0)
Table A-21. SPI Master Mode Timing Characteristics
Num
C
Characteristic
Symbol
Min
Typ
Max
Unit
1
P
SCK Frequency
fsck
1/2048
—
1
/2fbus
1
P
SCK Period
tsck
2
—
2048
tbus
2
D
Enable Lead Time
tlead
—
1/2
—
tsck
3
D
Enable Lag Time
tlag
—
1/2
—
tsck
4
D
Clock (SCK) High or Low Time
twsck
—
1/2
—
tsck
5
D
Data Setup Time (Inputs)
tsu
8—
—
ns
6
D
Data Hold Time (Inputs)
thi
8—
—
ns
9
D
Data Valid after SCK Edge
tvsck
—
30
ns
10
D
Data Valid after SS fall (CPHA=0)
tvss
—
15
ns
11
D
Data Hold Time (Outputs)
tho
20
—
ns
12
D
Rise and Fall Time Inputs
tr
——
8
ns
13
D
Rise and Fall Time Outputs
trfo
——
8
ns
SCK
(INPUT)
SCK
(INPUT)
MOSI
(INPUT)
MISO
(OUTPUT)
SS
(INPUT)
1
9
5
6
MSB IN
BIT 6 . . . 1
LSB IN
SLAVE MSB
SLAVE LSB OUT
BIT 6 . . . 1
11
4
2
7
(CPOL
= 0)
(CPOL
= 1)
3
13
NOTE: Not defined!
12
11
SEE
13
NOTE
8
10
see
note
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