參數(shù)資料
型號(hào)： MC9S12C96VFUE25
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP80
封裝： PLASTIC, QFP-80
文件頁(yè)數(shù)： 178/684頁(yè)
文件大小： 5287K
代理商： MC9S12C96VFUE25
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Chapter 9 Clocks and Reset Generator (CRGV4) Block Description
Freescale Semiconductor
MC9S12C-Family / MC9S12GC-Family
259
Rev 01.22
9.3.2.5
CRG Interrupt Enable Register (CRGINT)
This register enables CRG interrupt requests.
Read: anytime
Write: anytime
1
SCMIF
Self-Clock Mode Interrupt Flag — SCMIF is set to 1 when SCM status bit changes. This ag can only be
cleared by writing a 1. Writing a 0 has no effect. If enabled (SCMIE=1), SCMIF causes an interrupt request.
0 No change in SCM bit.
1 SCM bit has changed.
0
SCM
Self-Clock Mode Status Bit — SCM reects the current clocking mode. Writes have no effect.
0 MCU is operating normally with OSCCLK available.
1 MCU is operating in self-clock mode with OSCCLK in an unknown state. All clocks are derived from PLLCLK
running at its minimum frequency fSCM.
Module Base + 0x0004
76543210
R
RTIE
00
LOCKIE
00
SCMIE
0
W
Reset
0
00000
= Unimplemented or Reserved
Figure 9-8. CRG Interrupt Enable Register (CRGINT)
Table 9-3. CRGINT Field Descriptions
Field
Description
7
RTIE
Real-Time Interrupt Enable Bit
0 Interrupt requests from RTI are disabled.
1 Interrupt will be requested whenever RTIF is set.
4
LOCKIE
Lock Interrupt Enable Bit
0 LOCK interrupt requests are disabled.
1 Interrupt will be requested whenever LOCKIF is set.
1
SCMIE
Self-Clock Mode Interrupt Enable Bit
0 SCM interrupt requests are disabled.
1 Interrupt will be requested whenever SCMIF is set.
Table 9-2. CRGFLG Field Descriptions (continued)
Field
Description
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