參數(shù)資料
型號(hào)： MC9S12XEP100F1VAAR
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP80
封裝： PLASTIC, QFP-80
文件頁(yè)數(shù)： 928/1324頁(yè)
文件大小： 8453K
代理商： MC9S12XEP100F1VAAR
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Chapter 16 Freescale’s Scalable Controller Area Network (S12MSCANV3)
MC9S12XE-Family Reference Manual Rev. 1.21
Freescale Semiconductor
641
Because of an order from the United States International Trade Commission, BGA-packaged product lines and partnumbers
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software simpler because only one address area is applicable for the transmit process, and the required
address space is minimized.
The CPU then stores the identier, the control bits, and the data content into one of the transmit buffers.
Finally, the buffer is agged as ready for transmission by clearing the associated TXE ag.
The MSCAN then schedules the message for transmission and signals the successful transmission of the
buffer by setting the associated TXE ag. A transmit interrupt (see Section 16.4.7.2, “Transmit Interrupt”)
is generated1 when TXEx is set and can be used to drive the application software to re-load the buffer.
If more than one buffer is scheduled for transmission when the CAN bus becomes available for arbitration,
the MSCAN uses the local priority setting of the three buffers to determine the prioritization. For this
purpose, every transmit buffer has an 8-bit local priority eld (PRIO). The application software programs
this eld when the message is set up. The local priority reects the priority of this particular message
relative to the set of messages being transmitted from this node. The lowest binary value of the PRIO eld
is dened to be the highest priority. The internal scheduling process takes place whenever the MSCAN
arbitrates for the CAN bus. This is also the case after the occurrence of a transmission error.
When a high priority message is scheduled by the application software, it may become necessary to abort
a lower priority message in one of the three transmit buffers. Because messages that are already in
transmission cannot be aborted, the user must request the abort by setting the corresponding abort request
(CANTARQ)”.) The MSCAN then grants the request, if possible, by:
1. Setting the corresponding abort acknowledge ag (ABTAK) in the CANTAAK register.
2. Setting the associated TXE ag to release the buffer.
3. Generating a transmit interrupt. The transmit interrupt handler software can determine from the
setting of the ABTAK ag whether the message was aborted (ABTAK = 1) or sent (ABTAK = 0).
16.4.2.3
Receive Structures
The received messages are stored in a ve stage input FIFO. The ve message buffers are alternately
mapped into a single memory area (see Figure 16-39). The background receive buffer (RxBG) is
exclusively associated with the MSCAN, but the foreground receive buffer (RxFG) is addressable by the
CPU (see Figure 16-39). This scheme simplies the handler software because only one address area is
applicable for the receive process.
All receive buffers have a size of 15 bytes to store the CAN control bits, the identier (standard or
extended), the data contents, and a time stamp, if enabled (see Section 16.3.3, “Programmer’s Model of
signals the status of the foreground receive buffer. When the buffer contains a correctly received message
with a matching identier, this ag is set.
On reception, each message is checked to see whether it passes the lter (see Section 16.4.3, “Identier
Acceptance Filter”) and simultaneously is written into the active RxBG. After successful reception of a
valid message, the MSCAN shifts the content of RxBG into the receiver FIFO, sets the RXF ag, and
1. The transmit interrupt occurs only if not masked. A polling scheme can be applied on TXEx also.
相關(guān)PDF資料
PDF描述
MC9S12XEP100J1CAA 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP80
MC3S12XEP100F1MAGR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, QFP144
MC9S12XEP100F1MAAR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, QFP80
MC3S12XEP100J1CAAR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP80
MC3S12XEP100J1MVLR 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, BGA208
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MC9S12XEP100J5MAL 5M48H 制造商:Freescale Semiconductor 功能描述:
MC9S12XEP100MAG 功能描述:16位微控制器 - MCU 1M FLASH S12XEP SAILFI RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時(shí)鐘頻率:24 MHz 程序存儲(chǔ)器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
MC9S12XEP100MAG 制造商:Freescale Semiconductor 功能描述:HCS12 16-BIT MICROCONTROLLER IC
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MC9S12XEP100MAL 制造商:Freescale Semiconductor 功能描述:HCS12 16-BIT MICROCONTROLLER IC
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