參數(shù)資料
型號： MCF52210CAE66
廠商： Freescale Semiconductor
文件頁數(shù)： 13/56頁
文件大?。?/td> 0K
描述： IC MCU 64K FLASH 66MHZ 64LQFP
標準包裝： 160
系列： MCF5221x
核心處理器： Coldfire V2
芯體尺寸： 32-位
速度： 66MHz
連通性： I²C，SPI，UART/USART，USB OTG
外圍設備： DMA，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 43
程序存儲器容量： 64KB（64K x 8）
程序存儲器類型： 閃存
RAM 容量： 16K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉換器： A/D 8x12b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-LQFP
包裝： 托盤
配用： M52210DEMO-ND - BOARD DEV MCF5221X LOW COST
MCF5
2211
ColdFir
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.
2
Freescale
Se
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F
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Con
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uratio
ns
UART 1
UCTS1
SYNCA
URXD2
GPIO
PDSR[15]
PSRR[15]
—
98
C3
61
URTS1
SYNCB
UTXD2
GPIO
PDSR[14]
PSRR[14]
—
4
B1
2
URXD1
—
GPIO
PDSR[13]
PSRR[13]
—
100
B2
63
UTXD1
—
GPIO
PDSR[12]
PSRR[12]
—
99
A2
62
UART 2
UCTS2
—
GPIO
PDSR[27]
PSRR[27]
—
27
—
URTS2
—
GPIO
PDSR[26]
PSRR[26]
—
30
—
URXD2
—
GPIO
PDSR[25]
PSRR[25]
—
28
—
UTXD2
—
GPIO
PDSR[24]
PSRR[24]
—
29
—
VSTBY
—
N/A
—
55
F8
37
USB
VDDUSB
—
N/A
—
62
D8
43
VSSUSB
—
N/A
—
59
F7
40
USB_DM
—
N/A
—
61
D9
42
USB_DP
—
N/A
—
60
E9
41
VDD
—
N/A
—
1,2,14,22,
23,34,41,
57,68,81,93
D5,E3–E7,
F5
1,10,20,39,5
2
VSS
—
N/A
—
3,15,24,25,3
5,42,56,
67,75,82,92
A1,A9,D4,D
6,F4,F6,J1
11,21,38,
53,64
1 The PDSR and PSSR registers are described in the General Purpose I/O chapter. All programmable signals default to 2 mA drive and FAST slew rate in
normal (single-chip) mode.
2 All signals have a pull-up in GPIO mode.
3 These signals are multiplexed on other pins.
4 For primary and GPIO functions only.
5 Only when JTAG mode is enabled.
6 CLKMOD0 and CLKMOD1 have internal pull-down resistors; however, the use of external resistors is very strongly recommended.
7 When these pins are configured for USB signals, they should use the USB transceiver’s internal pull-up/pull-down resistors (see the description of the
OTG_CTRL register). If these pins are not configured for USB signals, each pin should be pulled down externally using a 10 k
resistor.
8 For secondary and GPIO functions only.
9 RSTI has an internal pull-up resistor; however, the use of an external resistor is very strongly recommended.
10 For GPIO function. Primary Function has pull-up control within the GPT module.
Table 3. Pin Functions by Primary and Alternate Purpose (continued)
Pin
Group
Primary
Function
Secondary
Function
Tertiary
Function
Quaternary
Function
Drive
Strength /
Control1
Slew Rate /
Control1
Pull-up /
Pull-down2
Pin on
100 LQFP
Pin on 81
MAPBGA
Pin on 64
LQFP/QFN
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