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參數(shù)資料
| 型號： | MCHC11F1VFNE3 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 7/158頁 |
| 文件大小： | 0K |
| 描述： | MCU 8BIT 1KRAM 512EE 68-PLCC |
| 標準包裝： | 18 |
| 系列： | HC11 |
| 核心處理器： | HC11 |
| 芯體尺寸： | 8-位 |
| 速度： | 3MHz |
| 連通性： | SCI，SPI |
| 外圍設備： | POR，WDT |
| 輸入/輸出數(shù)： | 30 |
| 程序存儲器類型： | ROMless |
| EEPROM 大?。?/td> | 512 x 8 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.75 V ~ 5.25 V |
| 數(shù)據(jù)轉換器： | A/D 8x8b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 包裝： | 管件 |
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SERIAL PERIPHERAL INTERFACE
MC68HC11F1
8-6
TECHNICAL DATA
SPIE — Serial Peripheral Interrupt Enable
Set the SPE bit to one to request a hardware interrupt sequence each time the SPIF
or MODF status ag is set. SPI interrupts are inhibited if this bit is clear or if the I bit in
the condition code register is one.
0 = SPI system interrupts disabled
1 = SPI system interrupts enabled
SPE — Serial Peripheral System Enable
When the SPE bit is set, the port D bit 2, 3, 4, and 5 pins are dedicated to the SPI func-
tion. If the SPI is in the master mode and DDRD bit 5 is set, then the port D bit 5 pin
becomes a general-purpose output instead of the SS input.
0 = SPI system disabled
1 = SPI system enabled
DWOM — Port D Wired-OR Mode
DWOM affects all port D pins.
0 = Normal CMOS outputs
1 = Open-drain outputs
MSTR — Master Mode Select
0 = Slave mode
1 = Master mode
CPOL — Clock Polarity
When the clock polarity bit is cleared and data is not being transferred, the SCK pin of
the master device has a steady state low value. When CPOL is set, SCK idles high.
Refer to Figure 8-2 and 8.2.1 Clock Phase and Polarity Controls.
CPHA — Clock Phase
The clock phase bit, in conjunction with the CPOL bit, controls the clock-data relation-
ship between master and slave. The CPHA bit selects one of two different clocking
protocols. Refer to Figure 8-2 and 8.2.1 Clock Phase and Polarity Controls.
SPR[1:0] — SPI Clock Rate Selects
These two bits select the SPI clock (SCK) rate when the device is configured as mas-
ter. When the device is configured as slave, these bits have no effect. Refer to Table
8-1.
Table 8-1 SPI Clock Rates
SPR[1:0]
E Clock
Divide By
Frequency at
E = 2 MHz
Frequency at
E = 3 MHz
Frequency at
E = 4 MHz
Frequency at
E = 5 MHz
0 0
2
1.0 MHz
1.5 MHz
2.0 MHz
2.5 MHz
0 1
4
500 kHz
750 kHz
1.0 MHz
625 kHz
1 0
16
125 kHz
187.5 kHz
250 kHz
156.25 kHz
1 1
32
62.5 kHz
93.7 kHz
125 kHz
78.125 kHz
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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參數(shù)描述 |
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| MCHC705B16NVFNE | 功能描述:IC MCU 8BIT 15K OTP 52-PLCC RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:HC05 標準包裝:1 系列:87C 核心處理器:MCS 51 芯體尺寸:8-位 速度:16MHz 連通性:SIO 外圍設備:- 輸入/輸出數(shù):32 程序存儲器容量:8KB（8K x 8） 程序存儲器類型:OTP EEPROM 大小:- RAM 容量:256 x 8 電壓 - 電源 (Vcc/Vdd):4 V ~ 6 V 數(shù)據(jù)轉換器:- 振蕩器型:外部 工作溫度:0°C ~ 70°C 封裝/外殼:44-DIP 包裝:管件 其它名稱:864285 |
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