參數資料
型號: MCHRC705J1ACDWE
廠商: Freescale Semiconductor
文件頁數: 10/162頁
文件大小: 0K
描述: MCU 8BIT 64B RAM 20-SOIC
標準包裝: 38
系列: HC05
核心處理器: HC05
芯體尺寸: 8-位
速度: 4MHz
外圍設備: POR,WDT
輸入/輸出數: 14
程序存儲器容量: 1.2KB(1.2K x 8)
程序存儲器類型: OTP
RAM 容量: 64 x 8
電壓 - 電源 (Vcc/Vdd): 3 V ~ 5.5 V
振蕩器型: 內部
工作溫度: -40°C ~ 85°C
封裝/外殼: 20-SOIC(0.295",7.50mm 寬)
包裝: 管件
External Interrupt Module (IRQ)
External Interrupt Timing
MC68HC705J1A — Rev. 4.0
Technical Data
External Interrupt Module (IRQ)
8.5 External Interrupt Timing
Figure 8-4. External Interrupt Timing
8.5.1 5.0-Volt External Interrupt Timing Characteristics
8.5.2 3.3-Volt External Interrupt Timing Characteristics
Characteristic(1)
1. VDD = 5.0 Vdc ± 10%, VSS = 0 Vdc, TA = –40°C to +105°C, unless otherwise noted
Symbol
Min
Max
Unit
IRQ interrupt pulse width low (edge-triggered)
tILIH
1.5
tcyc
(2)
2.
tcyc = 1/fop; fop = fosc/2.
IRQ interrupt pulse width (edge- and level-triggered)
tILIH
1.5
Note(3)
3. The minimum, tILIL, should not be less than the number of interrupt service routine cycles plus 19 tcyc.
tcyc
PA0–PA3 interrupt pulse width high (edge-triggered)
tILIL
1.5
tcyc
PA0–PA3 interrupt pulse width high (edge- and level-triggered)
tILIH
1.5
Note(3)
tcyc
Characteristic(1)
1. VDD = 3.3 Vdc ± 10%, VSS = 0 Vdc, TA = –40°C to +105°C, unless otherwise noted
Symbol
Min
Max
Unit
IRQ interrupt pulse width low (edge-triggered)
tILIH
1.5
tcyc
(2)
2.
tcyc = 1/fop; fop = fosc/2.
IRQ interrupt pulse width (edge- and level-triggered)
tILIH
1.5
Note(3)
3. The minimum, tILIL, should not be less than the number of interrupt service routine cycles plus 19 tcyc.
tcyc
PA0–PA3 interrupt pulse width high (edge-triggered)
tILIL
1.5
tcyc
PA0–PA3 interrupt pulse width high (edge- and level-triggered)
tILIH
1.5
Note(3)
tcyc
IRQ (INTERNAL)
tILIH
tILIL
tILIH
IRQ PIN
IRQ1
IRQn
.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
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n
c
..
.
相關PDF資料
PDF描述
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