參數(shù)資料
型號： MCIMX255AVM4
廠商： Freescale Semiconductor
文件頁數(shù)： 128/140頁
文件大小： 0K
描述： IC MPU I.MX25 AUTO 400MAPBGA
標(biāo)準(zhǔn)包裝： 90
系列： i.MX25
核心處理器： ARM9
芯體尺寸： 32-位
速度： 400MHz
連通性： 1 線，CAN，EBI/EMI，以太網(wǎng)，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG
外圍設(shè)備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 128
程序存儲器類型： 外部程序存儲器
RAM 容量： 144K x 8
電壓 - 電源 (Vcc/Vdd)： 1.15 V ~ 1.52 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 3x12b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 400-LFBGA
包裝： 托盤
i.MX25 Applications Processor for Automotive Products, Rev. 10
88
Freescale Semiconductor
3.7.9.3
RMII Mode Timing
In RMII mode, FEC_TX_CLK is used as the REF_CLK, which is a 50 MHz ± 50 ppm continuous
reference clock. FEC_RX_DV is used as the CRS_DV in RMII. Other signals under RMII mode include
FEC_TX_EN, FEC_TXD[1:0], FEC_RXD[1:0] and FEC_RX_ER.
Figure 59 shows RMII mode timings. Table 66 describes the timing parameters (M16–M21) shown in the
figure.
Figure 59. RMII Mode Signal Timing Diagram
Table 66. RMII Signal Timing
ID
Characteristic
Min.
Max.
Unit
M16
REF_CLK(FEC_TX_CLK) pulse width high
35%
65%
REF_CLK period
M17
REF_CLK(FEC_TX_CLK) pulse width low
35%
65%
REF_CLK period
M18
REF_CLK to FEC_TXD[1:0], FEC_TX_EN invalid
3
—
ns
M19
REF_CLK to FEC_TXD[1:0], FEC_TX_EN valid
—
12
ns
M20
FEC_RXD[1:0], CRS_DV(FEC_RX_DV), FEC_RX_ER to REF_CLK setup
2
—
ns
M21
REF_CLK to FEC_RXD[1:0], FEC_RX_DV, FEC_RX_ER hold
2
—
ns
REF_CLK (input)
FEC_TX_EN
M16
M17
M18
M19
M20
M21
FEC_RXD[1:0]
FEC_TXD[1:0] (output)
FEC_RX_ER
CRS_DV (input)
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PDF描述
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