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參數(shù)資料
| 型號(hào)： | MCIMX27LMOP4A |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 117/152頁 |
| 文件大小： | 0K |
| 描述： | IC MPU I.MX27 IN 19X19 473MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 84 |
| 系列： | i.MX27 |
| 核心處理器： | ARM9 |
| 芯體尺寸： | 32-位 |
| 速度： | 400MHz |
| 連通性： | 1 線，CAN，EBI/EMI，以太網(wǎng)，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外圍設(shè)備： | DMA，LCD，POR，PWM，WDT |
| 程序存儲(chǔ)器類型： | ROMless |
| RAM 容量： | 45K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.38 V ~ 1.52 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 473-LFBGA |
| 包裝： | 托盤 |
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i.MX27 and i.MX27L Data Sheet, Rev. 1.8
Freescale Semiconductor
67
Electrical Characteristics
4.3.7
NAND Flash Controller Interface (NFC)
Figure 31, Figure 32, Figure 33, and Figure 34 show the relative timing requirements among different
signals of the NFC at module level, and Table 35 lists the timing parameters. The NAND Flash Controller
(NFC) timing parameters are based on the internal NFC clock generated by the Clock Controller module,
where time T is the period of the NFC clock in ns. The relationship between the NFC clock and the external
timing parameters of the NFC is provided in Table 35.
Table 35 also provides two examples of external timing parameters with NFC clock frequencies of
22.17 MHz and 33.25 MHz. Assuming a 266 MHz FCLK (CPU clock), NFCDIV should be set to
divide-by-12 to generate a 22.17 MHz NFC clock and divide-by-8 to generate a 33.25 MHz NFC clock.
The user should compare the parameters of the selected NAND Flash memory with the NFC external
timing parameters to determine the proper NFC clock. The maximum NFC clock allowed is 66 MHz. It
should also be noted that the default NFC clock on power up is 16.63 MHz.
MSHC_BS
Setup time
tBSsu
5
—
ns
Hold time
tBSh
5
—
ns
MSHC_DATA
Setup time
tDsu
5
—
ns
Hold time
tDh
5
—
ns
Output delay time
tDd
—
15
ns
Table 34. Parallel Interface Timing Parameters
Signal
Parameter
Symbol
Standards
Unit
Min
Max
MSHC_SCLK
Cycle
tSCLKc
25
—
ns
H pulse length
tSCLKwh
5
—
ns
L pulse length
tSCLKwl
5
—
ns
Rise time
tSCLKr
—
10
ns
Fall time
tSCLKf
—
10
ns
MSHC_BS
Setup time
tBSsu
8
—
ns
Hold time
tBSh
1
—
ns
MSHC_DATA
Setup time
tDsu
8
—
ns
Hold time
tDh
1
—
ns
Output delay time
tDd
—
15
ns
Table 33. Serial Interface Timing Parameters (continued)
Signal
Parameter
Symbol
Standards
Unit
Min.
Max.
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PDF描述 |
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