參數(shù)資料
型號： MCIMX27VJP4AR2
廠商： Freescale Semiconductor
文件頁數(shù)： 107/152頁
文件大?。?/td> 0K
描述： IC MPU IMX27 404TMAP
標準包裝： 1,000
系列： i.MX27
核心處理器： ARM9
芯體尺寸： 32-位
速度： 400MHz
連通性： 1 線，CAN，EBI/EMI，以太網(wǎng)，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG
外圍設(shè)備： DMA，LCD，POR，PWM，WDT
程序存儲器類型： ROMless
RAM 容量： 45K x 8
電壓 - 電源 (Vcc/Vdd)： 1.38 V ~ 1.52 V
振蕩器型： 外部
工作溫度： -20°C ~ 85°C
封裝/外殼： 404-LFBGA
包裝： 帶卷 (TR)
i.MX27 and i.MX27L Data Sheet, Rev. 1.8
58
Freescale Semiconductor
Electrical Characteristics
4.3.2.2
MII Transmit Signal Timing (FEC_TXD[3:0], FEC_TX_EN, FEC_TX_ER,
and FEC_TX_CLK)
The transmitter functions correctly up to a FEC_TX_CLK maximum frequency of 25 MHz + 1%. There
is no minimum frequency requirement. In addition, the FEC IPG clock frequency must exceed twice the
FEC_TX_CLK frequency.
Figure 18 shows the MII transmit signal timings, and Table 26 lists the timing parameters.
Figure 18. MII Transmit Signal Timing Diagram
M4
FEC_RX_CLK pulse width low
35%
65%
FEC_RX_CLK period
Note:
1
FEC_RX_DV, FEC_RX_CLK, and FEC_RXD0 have the same timing in 10 Mbps 7-wire interface mode.
Table 26. MII Transmit Signal Timing Parameters
ID
Parameter1
1
FEC_TX_EN, FEC_TX_CLK, and FEC_TXD0 have the same timing in 10 Mbps 7-wire interface mode.
Min
Max
Unit
M5
FEC_TX_CLK to FEC_TXD[3:0], FEC_TX_EN, FEC_TX_ER invalid
5
—
ns
M6
FEC_TX_CLK to FEC_TXD[3:0], FEC_TX_EN, FEC_TX_ER valid
—
20
ns
M7
FEC_TX_CLK pulse width high
35%
65%
FEC_TX_CLK period
M8
FEC_TX_CLK pulse width low
35%
65%
FEC_TX_CLK period
Note:
Table 25. MII Receive Signal Timing Parameters (continued)
ID
Parameter1
Min
Max
Unit
FEC_TX_CLK (input)
FEC_TXD[3:0] (outputs)
FEC_TX_EN
FEC_TX_ER
M7
M8
M5
M6
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