參數資料
型號： MCIMX351AVM4BR2
廠商： Freescale Semiconductor
文件頁數： 145/147頁
文件大?。?/td> 0K
描述： IC MPU I.MX35 400MAPBGA
標準包裝： 1,000
系列： i.MX35
核心處理器： ARM11
芯體尺寸： 32-位
速度： 400MHz
連通性： 1 線，CAN，EBI/EMI，以太網，I²C，MMC，SPI，SSI，UART/USART，USB OTG
外圍設備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數： 96
程序存儲器類型： ROMless
RAM 容量： 128K x 8
電壓 - 電源 (Vcc/Vdd)： 1.22 V ~ 1.47 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 400-LFBGA
包裝： 帶卷 (TR)
i.MX35 Applications Processors for Automotive Products, Rev. 10
Freescale Semiconductor
97
4.9.15
MediaLB Controller Electrical Specifications
This section describes the electrical information of the MediaLB Controller module.
MSHC_DATA
Setup time
tDsu
5
—
ns
Hold time
tDh
5
—
ns
Output delay time
tDd
—
15
ns
1 Timing is guaranteed for NVCC from 2.7 V through 3.1 V and up to a maximum overdrive NVCC of 3.3 V. See NVCC
restrictions described in Table 61.
Table 61. Parallel Interface Timing Parameters1
1 Timing is guaranteed for NVCC from 2.7 V through 3.1 V and up to a maximum overdrive NVCC of 3.3 V. See the NVCC
restrictions described in Table 8.
Signal
Parameter
Symbol
Standards
Unit
Min.
Max.
MSHC_SCLK
Cycle
tSCLKc
25
—
ns
H pulse length
tSCLKwh
5
—
ns
L pulse length
tSCLKwl
5
—
ns
Rise time
tSCLKr
—
10
ns
Fall time
tSCLKf
—
10
ns
MSHC_BS
Setup time
tBSsu
8
—
ns
Hold time
tBSh
1
—
ns
MSHC_DATA
Setup time
tDsu
8
—
ns
Hold time
tDh
1
—
ns
Output delay time
tDd
—
15
ns
Table 62. MLB 256/512 Fs Timing Parameters
Parameter
Symbol
Min
Typ
Max
Units
Comment
MLBCLK operating frequency1
fmck
11.264
12.288
24.576
24.6272
25.600
MHz
Min: 256
× Fs at 44.0 kHz
Typ: 256
× Fs at 48.0 kHz
Typ: 512
× Fs at 48.0 kHz
Max: 512
× Fs at 48.1 kHz
Max: 512
× Fs PLL unlocked
MLBCLK rise time
tmckr
——
3
ns
VIL TO VIH
Table 60. Serial Interface Timing Parameters1 (continued)
Signal
Parameter
Symbol
Standards
Unit
Min.
Max.
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PDF描述
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參數描述
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