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參數(shù)資料
| 型號(hào)： | MCP4131-103E/SN |
| 廠商： | Microchip Technology |
| 文件頁(yè)數(shù)： | 50/59頁(yè) |
| 文件大小： | 0K |
| 描述： | IC POT DGTL SNGL 10K SPI 8SOIC |
| 標(biāo)準(zhǔn)包裝： | 100 |
| 接片： | 129 |
| 電阻（歐姆）： | 10k |
| 電路數(shù)： | 1 |
| 溫度系數(shù)： | 標(biāo)準(zhǔn)值 150 ppm/°C |
| 存儲(chǔ)器類型： | 易失 |
| 接口： | 3 線 SPI（芯片選擇） |
| 電源電壓： | 1.8 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 8-SOICN |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁(yè)面： | 675 (CN2011-ZH PDF) |
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Micrel, Inc.
KSZ8051MNL/RNL
July 2010
54
M9999-070910-1.0
Reset Timing
The KSZ8051MNL/RNL reset timing requirement is summarized in the following figure and table.
Figure 18. Reset Timing
Parameter
Description
Min
Max
Units
tsr
Stable supply voltage (VDDIO, VDDA_3.3) to reset high
10
ms
tcs
Configuration setup time
5
ns
tch
Configuration hold time
5
ns
trc
Reset to strap-in pin output
6
ns
Table 19. Reset Timing Parameters
After the de-assertion of reset, it is recommended to wait a minimum of 100s before starting programming on the MIIM
(MDC/MDIO) Interface.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VE-JTW-MZ | CONVERTER MOD DC/DC 5.5V 25W |
| VI-B2X-MY-F1 | CONVERTER MOD DC/DC 5.2V 50W |
| MCP4011-103E/MS | IC DGTL POT 10K 1CH 8MSOP |
| DS1746P-70+ | IC RTC RAM Y2K 5V 70NS 34-PCM |
| VI-B2W-MY-F4 | CONVERTER MOD DC/DC 5.5V 50W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MCP4131-103I/MF | 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:7/8-Bit Single/Dual SPI Digital POT with Volatile Memory |
| MCP4131-103I/ML | 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:7/8-Bit Single/Dual SPI Digital POT with Volatile Memory |
| MCP4131-103I/MS | 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:7/8-Bit Single/Dual SPI Digital POT with Volatile Memory |
| MCP4131-103I/P | 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:7/8-Bit Single/Dual SPI Digital POT with Volatile Memory |
| MCP4131-103I/SL | 制造商:MICROCHIP 制造商全稱:Microchip Technology 功能描述:7/8-Bit Single/Dual SPI Digital POT with Volatile Memory |
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