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參數(shù)資料
| 型號： | MD83C154DCXXX-12P883D |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CDIP40 |
| 文件頁數(shù)： | 22/242頁 |
| 文件大?。?/td> | 3080K |
| 代理商： | MD83C154DCXXX-12P883D |
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118
2588F–AVR–06/2013
ATtiny261/461/861
Table 12-20 shows the COM1D1:0 bit functionality when the PWM1D and WGM11:10 bits are
set to Phase and Frequency Correct PWM Mode.
Bit 1 – FOC1D: Force Output Compare Match 1D
The FOC1D bit is only active when the PWM1D bit specify a non-PWM mode.
Writing a logical one to this bit forces a change in the Waveform Output (OCW1D) and the Out-
put Compare pin (OC1D) according to the values already set in COM1D1 and COM1D0. If
COM1D1 and COM1D0 written in the same cycle as FOC1D, the new settings will be used. The
Force Output Compare bit can be used to change the output pin value regardless of the timer
value. The automatic action programmed in COM1D1 and COM1D0 takes place as if a compare
match had occurred, but no interrupt is generated. The FOC1D bit is always read as zero.
Bit 0 – PWM1D: Pulse Width Modulator D Enable
When set (one) this bit enables PWM mode based on comparator OCR1D.
12.12.4
TCCR1D – Timer/Counter1 Control Register D
Bit 7 – FPIE1: Fault Protection Interrupt Enable
Setting this bit (to one) enables the Fault Protection Interrupt.
Bit 6 – FPEN1: Fault Protection Mode Enable
Setting this bit (to one) activates the Fault Protection Mode.
Bit 5 – FPNC1: Fault Protection Noise Canceler
Setting this bit activates the Fault Protection Noise Canceler. When the noise canceler is acti-
vated, the input from the Fault Protection Pin (INT0) is filtered. The filter function requires four
successive equal valued samples of the INT0 pin for changing its output. The Fault Protection is
therefore delayed by four Oscillator cycles when the noise canceler is enabled.
Bit 4 – FPES1: Fault Protection Edge Select
This bit selects which edge on the Fault Protection pin (INT0) is used to trigger a fault event.
When the FPES1 bit is written to zero, a falling (negative) edge is used as trigger, and when the
FPES1 bit is written to one, a rising (positive) edge will trigger the fault.
Table 12-20. Compare Output Mode, Phase and Frequency Correct PWM Mode
COM1D1:0
OCW1D Behaviour
OC1D Pin
00
Normal port operation.
Disconnected
01
Cleared on Compare Match when up-counting.
Set on Compare Match when down-counting.
Connected
10
Cleared on Compare Match when up-counting.
Set on Compare Match when down-counting.
Connected
Disconnected
11
Set on Compare Match when up-counting.
Cleared on Compare Match when down-counting.
Connected
Disconnected
Bit
76543210
FPIE1
FPEN1
FPNC1
FPES1
FPAC1
FPF1
WGM11
WGM10
TCCR1D
Read/Write
R/W
Initial value
00000000
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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