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參數(shù)資料
| 型號： | MF280C51-12R |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP44 |
| 文件頁數(shù)： | 65/290頁 |
| 文件大小： | 4178K |
| 代理商： | MF280C51-12R |
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Debug Interface and EmbeddedICE-RT
ARM DDI 0165B
Copyright 2000 ARM Limited. All rights reserved.
7-19
A typical use of this bit is by a monitor mode debug aware abort handler. This examines
the DbgAbt bit to determine whether the abort was externally or internally generated. If
the DbgAbt bit is set, the abort handler initiates communication with the debugger over
the comms channel.
7.8.4
Communications using the comms channel
You can send and receive messages using the comms channel. These are described in:
Sending a message to the debugger
Before the processor can send a message to the debugger, it must check that the comms
data write register is free for use by finding out if the W bit of the debug comms control
register is clear.
The processor reads the debug comms control register to check the status of the W bit:
If the W bit is clear, the comms data write register is clear.
If the W bit is set, previously written data has not been read by the debugger. The
processor must continue to poll the control register until the W bit is clear.
When the W bit is clear, a message is written by a register transfer to coprocessor 14.
As the data transfer occurs from the processor to the comms data write register, the W
bit is set in the debug comms control register.
The debugger has two options available for reading data from the comms data write
register:
Poll the debug comms channel control register before reading the comms data
written. If the W bit is set, there is valid data present in the debug comms data
write register. The debugger can then read this data and scan the data out. The
action of reading the data clears the debug comms channel control register W bit.
Then the communications process can begin again.
Poll the comms data write register, obtaining data and valid status. The data
scanned out consists of the contents of the comms data write register (which
might or might not be valid), and a flag that indicates whether the data read is
valid or not. The status flag is present in the Addr[0] bit position of scan chain 2
when the data is scanned out. See Test data registers on page C-10 for details of
scan chain 2.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M43C505F | 4-BIT, MROM, 2 MHz, MICROCONTROLLER |
| MQ80C32-20/883R | 8-BIT, 20 MHz, MICROCONTROLLER, CQFP44 |
| MQ80C52EXXX-25SBR | 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CQFP44 |
| MD83C154DTXXX-12P883D | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CDIP40 |
| MR83C154DTXXX-20/883 | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CQCC44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MF283C151C-12 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller |
| MF283C151C-16 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller |
| MF283C151C-20 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller |
| MF283C151C-25 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller |
| MF283C151C-30 | 制造商:TEMIC 制造商全稱:TEMIC Semiconductors 功能描述:CMOS 0 to 36 MHz Single Chip 8-bit Microcontroller |
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