參數(shù)資料
型號(hào)： MK1707S
元件分類： 時(shí)鐘及定時(shí)
英文描述： PLL BASED CLOCK DRIVER, PDSO8
封裝： 0.150 INCH, SOIC-8
文件頁數(shù)： 2/6頁
文件大?。?/td> 88K
代理商： MK1707S
Low EMI Clock Generator
MDS 1707 E
2
Revision 012203
Integrated Circuit Systems, Inc. q 525 Race Street, San Jose, CA 95126 q tel (408) 295-9800 q
www.icst.com
MK1707
Pin Assignment
Spread Direction and Percentage
Select Table
0 = connect to GND
M = unconnected (floating)
1 = connect directly to VDD
Pin Descriptions
ICLK
VDD
GND
S1
CLK
S0
LEE
SD
1
2
3
4
8
7
6
5
8 pin (150 mil) SOIC
SD
Pin 8
S1
Pin 7
S0
Pin 6
Spread
Direction
Spread
Percentage (%)
0
Down
0.6
00
M
Down
0.8
0
1
Down
1.25
0
M
0
Down Center
+0.5, -1.5
0M
M
Down
2
0
M
1
Down Center
+0.5, -2.5
0
1
0
Down Center
+0.5, -3
01
M
Down
5
0
1
Power Down
-
1
0
Center
±0.35
10
MCenter
±0.5
10
1Center
±0.7
1M
0Center
±0.8
1M
MCenter
±1.1
1M
1Center
±1.4
11
0Test
Test
11
MCenter
±2.5
11
1
Power Down
-
Pin
Number
Pin
Name
Pin Type
Pin Description
1
ICLK
Input
Connect to graphics input clock.
2
VDD
Power
Connect to +3.3 V.
3
GND
Power
Connect to ground.
4
CLK
Output
Spread spectrum clock output per table above.
5
LEE
Input
Low EMI enable. Turns on spread spectrum when high. Internal pull-up.
6
S0
Input
Function select 0 input. Selects spread amount and direction per table above.
Internal mid-level.
7
S1
Input
Function select 1input. Selects spread amount and direction per table above.
Internal mid-level.
8
SD
Input
Spread direction select input. Selects the direction of spread per table above.
Internal pull-up.
相關(guān)PDF資料
PDF描述
MK1709AGLF 1709 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8
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MK1709AGLF 1709 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8
MK1709AGLFTR 1709 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8
MK2302S-01LF 2302 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8
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參數(shù)描述
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