參數(shù)資料
型號: MK1725GLFTR
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 2/8頁
文件大小: 0K
描述: IC CLK GEN SPRD SPECTRUM 16TSSOP
標(biāo)準(zhǔn)包裝: 2,500
類型: 時鐘發(fā)生器
PLL:
輸入: 時鐘,晶體
輸出: CMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:4
差分 - 輸入:輸出: 無/無
頻率 - 最大: 136MHz
除法器/乘法器: 無/是
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 16-TSSOP
包裝: 帶卷 (TR)
MK1725
QUAD OUTPUT SPREAD SPECTRUM CLOCK GENERATOR
SSCG
IDT QUAD OUTPUT SPREAD SPECTRUM CLOCK GENERATOR
2
MK1725
REV G 033109
MK1725
QUAD OUTPUT SPREAD SPECTRUM CLOCK GENERATOR
SSCG
Pin Assignment
CLK Output Selection Table
Pin Descriptions
12
1
11
2
10
3
9
X1
4
S0
5
S3
6
VDD
7
VDD
8
GND
PDTS
S2
VDD
S1
GND
CLK3
CLK1
CLK4
16
15
14
13
CLK2
X2
16 pin (173 mil) TSSOP
S3
S2
S1
S0
CLK1:4
Multiplier
Spread %
00
1
-1%
00
10
1
-0.5%
00
01
1
+/- 0.5%
00
11
1
+/- 0.25%
01
10
2
-1%
01
2
-0.5%
01
00
2
+/- 0.5%
01
11
2
+/- 0.25%
10
00
4
-1%
10
4
-0.5%
10
01
4
+/- 0.5%
10
11
4
+/- 0.25%
11
10
1
OFF
11
01
2
OFF
11
00
4
OFF
1
TEST
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
X1
Input
Connect to a 20 to 34 MHz crystal or clock input.
2
S0
Input
Select pin 0. Determines frequency and spread amount on
output clocks as per table above. Internal pull-down.
3
S3
Input
Select pin 3. Determines frequency and spread amount on
output clocks as per table above. Internal pull-down.
4
VDD
Power
Connect to +3.3 V.
5
GND
Power
Connect to ground.
6
S1
Input
Select pin 1. Determines frequency and spread amount on
output clocks as per table above. Internal pull-down.
7
CLK1
Output
Clock 1 output. Frequency and spread amount are determined
by table above. Weak internal pull-down when tri-state.
8
CLK2
Output
Clock 2 output. Frequency and spread amount are determined
by table above. Weak internal pull-down when tri-state.
9
CLK3
Output
Clock 3 output. Frequency and spread amount are determined
by table above. Weak internal pull-down when tri-state.
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PDF描述
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