參數(shù)資料
型號: MK2712SLFTR
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 2/4頁
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描述: IC CLK SOURCE MTSC/PAL 8-SOIC
標(biāo)準(zhǔn)包裝: 2,500
類型: 時鐘合成器 - 視頻
PLL:
輸入: 時鐘
輸出: CMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:1
差分 - 輸入:輸出: 無/無
頻率 - 最大: 35.469MHz
除法器/乘法器: 無/無
電源電壓: 4.5 V ~ 5.5 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 8-SOIC(0.154",3.90mm 寬)
供應(yīng)商設(shè)備封裝: 8-SOIC
包裝: 帶卷 (TR)
MK2712
NTSC/PAL Clock Source
MDS 2712 D
2
Revision 092104
Integrated Circuit Systems 525 Race Street San Jose CA 95126 (408)297-1201tel www.icst.com
Number
Name
Type
Description
1
ICLK
I
Input Clock. Connect to a 27.0000 MHz clock.
2
VDD
P
Connect to +3.3V or +5V.
3
GND
P
Connect to ground.
4
NPCLK
O
NTSC or PAL output clock. Selected by FS1, FS0 per tables above.
5
FS1
I
Frequency Select pin #1. Selects NTSC or PAL frequency per table above.
6
OE
I
Output Enable. Tri-states clock output when this input is low. Internal pull-up.
7
PD
I
Power Down. Active low. Clocks stop low.
8
FS0
I
Frequency Select pin #0. Selects NTSC or PAL frequency per table above.
Pin Descriptions
Key: I = Input, O = output, P = power supply connection
Pin Assignment
External Components/Crystal Selection
A minimum number of external components are required for proper oscillation. Connect a 27.000 MHz clock to
ICLK. A decoupling capacitor of 0.1F should be connected between VDD and GND on pins 2 and 3, and a 33
terminating resistor should be used on the clock output if the trace is longer than 1 inch.
1
8
2
3
4
7
6
5
ICLK
FS0
GND
PD
VDD
OE
8 pin SOIC
NPCLK
Decoding Table
FS1
FS0
NPCLK (MHz)
Error (ppm)
0
14.31818
0.3 ppm
0
1
17.73447
0.3 ppm
1
0
28.63636
0.3 ppm
1
35.46894
0.3 ppm
FS1
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PDF描述
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參數(shù)描述
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