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參數(shù)資料
| 型號(hào)： | MK2772-01 |
| 英文描述： | VCXO and Set-Top Clock Source |
| 中文描述： | VCXO和機(jī)頂盒時(shí)鐘源 |
| 文件頁(yè)數(shù)： | 2/4頁(yè) |
| 文件大?。?/td> | 64K |
| 代理商： | MK2772-01 |
MK2772-01
VCXO and Set-Top Clock Source
MDS 2772-01 B
Integrated Circuit Systems, Inc.525
Race StreetSan JoseCA95126(408)295-9800telwww.icst.com
2
Revision 012098
Printed 11/16/00
ICRO
C
LOC K
Pin Descriptions
Key: I = Input, TI = tri-level input, VI = VCXO input, O = output, P = power supply connection, X = crystal connection
Pin Assignment
Number
1
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3
4
5
6
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9
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11
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14
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16
17
18
19
20
Name
ACS1
X2
X1
VDD
VIN
VDD
GND
16.67M
3.68M
ACLK
INMUXSEL
11.06M
27M
GND
VDD
27M
GND
27M
EXTCLKIN
ACS0
Type Description
TI
Audio Clock Select 1. Determines ACLK frequency, as per table above.
X
Crystal connection. Connect to a pullable 13.5 MHz crystal.
X
Crystal connection. Connect to a pullable 13.5 MHz crystal.
P
Connect to +5V, and other VDDs.
VI
Voltage Input to VCXO. Zero to 3V signal which controls the frequency of the VCXO.
P
Connect to +5V.
P
Connect to ground.
O
16.6667 MHz processor clock output.
O
3.6864 MHz clock output.
O
Audio Clock Output determined by ACS1,0. Per table above.
I
Input Multiplexer Select. Selects either the internal VCXO/PLL output, or the clock on pin 19.
O
11.0592 MHz clock output.
O
27.00 MHz clock output.
P
Connect to ground.
P
Connect to +5V.
O
27.00 MHz clock output.
P
Connect to ground.
O
27.00 MHz clock output.
I
External Clock Input. Connect an external 27 MHz clock to this pin for glitch free switching.
TI
Audio Clock Select 0. Determines ACLK frequency, as per table above.
1
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3
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9
16
15
14
13
12
11
VDD
VIN
VDD
GND
16.67M
X2
X1
VDD
GND
GND
27M
10
3.68M
ACLK
EXTCLKIN
27M
ACS1
ACS0
27M
11.06M
INMUXSEL
18
17
19
20
ACS1 ACS0 ACLK (MHz)
0
0
0
M
0
1
M
0
M
M
M
1
1
0
1
M
1
1
8.192
16.384
11.2896
16.9344
22.5792
18.432
12.288
24.576
5.6448
INMUXSEL
0
1
27 MHz Input
EXTCLKIN
Internal VCXO
Audio Clock Select
Input Source Select
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PDF描述 |
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參數(shù)描述 |
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