參數(shù)資料
型號: ML63512A-XXXTB
廠商: OKI ELECTRIC INDUSTRY CO LTD
元件分類: 微控制器/微處理器
英文描述: 4-BIT, MROM, 2 MHz, MICROCONTROLLER, PQFP48
封裝: PLASTIC, TQFP-48
文件頁數(shù): 79/250頁
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代理商: ML63512A-XXXTB
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1-4
ML63512A/514A User's Manual
Chapter 1 Overview
1.3 Block Diagram
Block diagram of the ML63512A and ML63514A is shown in Figure 1-1.
Asterisks (*) indicate the secondary function of each port. Signal names enclosed by chain
lines (
) indicate interface signals of the VDDI power supply system.
Port 6 (P6.0 to P6.3), Port 9 (P9.0 to P9.3) and Port A (PA.0 to PA.3) are provided for the
64-pin packages and chips.
Figure 1-1 ML63512A, ML63514A Block Diagram
ROM
ML63512A: 4KW
ML63514A: 8KW
BUS
CON-
TROL
MIE
XT0
XT1
OSC0
OSC1
TBCCLK
*
HSCLK
*
OSC
CBR
EBR
L
C
G
Z
ALU
RA
A
IR
INSTRUCTION
DECODER
RAM
ML63512A: 128N
ML63514A: 256N
CPU CORE nX-4/250
RESETB
RST
VDDI
PC
H
Y
X
TIMING
CON-
TROL
SP
RSP
STACK
CAL: 16-level
REG: 16-level
TIMER
8bit 2
RXD
*
TXC
*
RXC
*
TXD
*
2
INT
SIO
TM0CAP/TM1CAP
*
TM0OVF/TM1OVF
*
T0CK
*
T1CK
*
2
INT
I/O
PORT
P0.0-P0.3
P1.0-P1.3
P2.0-P2.3
P3.0-P3.3
P4.0-P4.3
P5.0-P5.3
P6.0-P6.3
=
P9.0-P9.3
=
PA.0-PA.3
=
4
INT
DATA
BUS
TBC
4
INT
1
VSS
MELODY
MD
1
INT
TST1B
TST
TST2B
P7.0-P7.3
INT
INPUT
PORT
P8.0-P8.3
OUTPUT
PORT
LDIN0
*
Level
Detector
LDIN1
*
CMPIN
*
CMP
CMPREF
*
VDDH
VDD
CB1
CB2
BACK-
UP
VDDL
VR
相關(guān)PDF資料
PDF描述
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ML67Q5003TC 32-BIT, FLASH, 60 MHz, RISC MICROCONTROLLER, PQFP144
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參數(shù)描述
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