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參數(shù)資料
| 型號： | MPC852TCVR50A |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 50 MHz, RISC PROCESSOR, PBGA256 |
| 封裝： | PLASTIC, BGA-256 |
| 文件頁數(shù)： | 37/80頁 |
| 文件大?。?/td> | 998K |
| 代理商： | MPC852TCVR50A |
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MPC852T PowerQUICC Hardware Specifications, Rev. 4
42
Freescale Semiconductor
IEEE 1149.1 Electrical Specifications
Figure 35 provides the reset timing for the debug port configuration.
Figure 35. Reset Timing—Debug Port Configuration
13 IEEE 1149.1 Electrical Specifications
Table 15. JTAG Timing
Num
Characteristic
All Frequencies
Unit
Min
Max
J82
TCK cycle time
100.00
—
ns
J83
TCK clock pulse width measured at 1.5 V
40.00
—
ns
J84
TCK rise and fall times
0.00
10.00
ns
J85
TMS, TDI data setup time
5.00
—
ns
J86
TMS, TDI data hold time
25.00
—
ns
J87
TCK low to TDO data valid
—
27.00
ns
J88
TCK low to TDO data invalid
0.00
—
ns
J89
TCK low to TDO high impedance
—
20.00
ns
J90
TRST assert time
100.00
—
ns
J91
TRST setup time to TCK low
40.00
—
ns
J92
TCK falling edge to output valid
—
50.00
ns
J93
TCK falling edge to output valid out of high impedance
—
50.00
ns
J94
TCK falling edge to output high impedance
—
50.00
ns
J95
Boundary scan input valid to TCK rising edge
50.00
—
ns
J96
TCK rising edge to boundary scan input invalid
50.00
—
ns
CLKOUT
SRESET
DSCK, DSDI
R70
R82
R80
R81
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC852TVR100 | 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256 |
| MPC852TZT80 | 32-BIT, 80 MHz, RISC PROCESSOR, PBGA256 |
| MPC852TZT50 | 32-BIT, 50 MHz, RISC PROCESSOR, PBGA256 |
| MPC852TZT80 | 32-BIT, 80 MHz, RISC PROCESSOR, PBGA256 |
| MPC852TVR100 | 32-BIT, 100 MHz, RISC PROCESSOR, PBGA256 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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