I2
參數(shù)資料
型號(hào)： MPC8533EVTALF
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 62/112頁(yè)
文件大?。?/td> 0K
描述： MPU POWERQUICC 783-PBGA
標(biāo)準(zhǔn)包裝： 36
系列： MPC85xx
處理器類型： 32-位 MPC85xx PowerQUICC III
速度： 667MHz
電壓： 0.95 V ~ 1.05 V
安裝類型： 表面貼裝
封裝/外殼： 783-BBGA，F(xiàn)CBGA
供應(yīng)商設(shè)備封裝： 783-FCPBGA（29x29）
包裝： 托盤
MPC8533E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 6
Freescale Semiconductor
53
I2C
Figure 33 provides the boundary-scan timing diagram.
Figure 33. Boundary-Scan Timing Diagram
13 I2C
This section describes the DC and AC electrical characteristics for the I2C interfaces of the MPC8533E.
13.1
I2C DC Electrical Characteristics
Table 46 provides the DC electrical characteristics for the I2C interfaces.
Table 46. I2C DC Electrical Characteristics
At recommended operating conditions with OVDD of 3.3 V ± 5%.
Parameter
Symbol
Min
Max
Unit
Notes
Input high voltage level
VIH
0.7
OV
DD
OVDD +0.3
V
—
Input low voltage level
VIL
–0.3
0.3
OV
DD
V—
Low level output voltage
VOL
00.2
OV
DD
V1
Pulse width of spikes which must be suppressed by the
input filter
tI2KHKL
050
ns
2
Input current each I/O pin (input voltage is between
0.1
OV
DD and 0.9 OVDD(max)
II
–10
10
A3
Capacitance for each I/O pin
CI
—10
pF
—
Notes:
1. Output voltage (open drain or open collector) condition = 3 mA sink current.
2. Refer to the MPC8533E PowerQUICC III Integrated Communications Host Processor Reference Manual for information on
the digital filter used.
3. I/O pins will obstruct the SDA and SCL lines if OVDD is switched off.
VM = Midpoint Voltage (OVDD/2)
VM
tJTDVKH
tJTDXKH
Boundary
Data Outputs
Boundary
Data Outputs
JTAG
External Clock
Boundary
Data Inputs
Output Data Valid
tJTKLDX
tJTKLDZ
tJTKLDV
Input
Data Valid
Output Data Valid
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