參數(shù)資料
型號(hào)： MPC8533EVTANG
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 800 MHz, MICROPROCESSOR, PBGA783
封裝： 29 X 29 MM, 1 MM PITCH, LEAD FREE, PLASTIC, FC-PBGA-783
文件頁數(shù)： 78/116頁
文件大小： 1273K
代理商： MPC8533EVTANG
MPC8533E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 3
64
Freescale Semiconductor
High-Speed Serial Interfaces (HSSI)
Single-ended Mode
— The reference clock can also be single-ended. The SDn_REF_CLK input amplitude
(single-ended swing) must be between 400 and 800 mV peak-peak (from Vmin to Vmax) with
SDn_REF_CLK either left unconnected or tied to ground.
—The SDn_REF_CLK input average voltage must be between 200 and 400 mV. Figure 44 shows
the SerDes reference clock input requirement for single-ended signaling mode.
— To meet the input amplitude requirement, the reference clock inputs might need to be DC or
AC-coupled externally. For the best noise performance, the reference of the clock could be DC
or AC-coupled into the unused phase (SDn_REF_CLK) through the same source impedance as
the clock input (SDn_REF_CLK) in use.
Figure 42. Differential Reference Clock Input DC Requirements (External DC-Coupled)
Figure 43. Differential Reference Clock Input DC Requirements (External AC-Coupled)
Figure 44. Single-Ended Reference Clock Input DC Requirements
SD
n_REF_CLK
SD
n_REF_CLK
Vmax < 800 mV
Vmin > 0 V
100 mV < Vcm < 400 mV
200 mV < Input Amplitude or Differential Peak < 800 mV
SD
n_REF_CLK
SD
n_REF_CLK
Vcm
200 mV < Input Amplitude or Differential Peak < 800 mV
Vmax < Vcm + 400 mV
Vmin > Vcm - 400 mV
SD
n_REF_CLK
SD
n_REF_CLK
400 mV < SDn_REF_CLK Input Amplitude < 800 mV
0V
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PDF描述
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參數(shù)描述
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