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參數(shù)資料
| 型號： | MPC8541EPXAPF |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 3/88頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU POWERQUICC III 783-FCPBGA |
| 標準包裝： | 36 |
| 系列： | MPC85xx |
| 處理器類型： | 32-位 MPC85xx PowerQUICC III |
| 速度： | 833MHz |
| 電壓： | 1.2V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 783-BBGA，F(xiàn)CBGA |
| 供應商設備封裝： | 783-FCPBGA（29x29） |
| 包裝： | 托盤 |
| 配用： | CWH-PPC-8540N-VE-ND - KIT EVAL SYSTEM MPC8540 |
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MPC8541E PowerQUICC III Integrated Communications Processor Hardware Specification, Rev. 4.2
Freescale Semiconductor
11
Electrical Characteristics
Figure 3 shows the undershoot and overshoot voltage of the PCI interface of the MPC8541E for the 3.3-V
signals, respectively.
Figure 3. Maximum AC Waveforms on PCI interface for 3.3-V Signaling
2.1.4
Output Driver Characteristics
Table 3 provides information on the characteristics of the output driver strengths. The values are
preliminary estimates.
Table 3. Output Drive Capability
Driver Type
Programmable Output
Impedance (
Ω)
Supply
Voltage
Notes
Local bus interface utilities signals
25
OVDD = 3.3 V
1
42 (default)
PCI signals
25
2
42 (default)
DDR signal
20
GVDD = 2.5 V
TSEC/10/100 signals
42
LVDD = 2.5/3.3 V
DUART, system control, I2C, JTAG
42
OVDD = 3.3 V
Notes:
1. The drive strength of the local bus interface is determined by the configuration of the appropriate bits in PORIMPSCR.
2. The drive strength of the PCI interface is determined by the setting of the PCI_GNT1 signal at reset.
11 ns
(Min)
Overvoltage
Waveform
Undervoltage
Waveform
4 ns
(Max)
4 ns
(Max)
62.5 ns
–3.5 V
+7.1 V
7.1 V p-to-p
(Min)
7.1 V p-to-p
(Min)
0 V
+3.6 V
相關PDF資料 |
PDF描述 |
|---|---|
| MPC8541EVTAPF | IC MPU POWERQUICC III 783-FCPBGA |
| MPC8541ECVTALF | IC MPU POWERQUICC III 783-FCPBGA |
| IDT71321SA25JG | IC SRAM 16KBIT 25NS 52PLCC |
| 4-1734839-9 | CONN FPC 49POS .5MM RT ANG SMD |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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