參數(shù)資料
型號： MPC8567CVTAUJJA
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 1333 MHz, RISC PROCESSOR, PBGA1023
封裝： 33 X 33 MM, 2.75 MM HEIGHT, 1 MM PITCH, LEAD FREE, PLASTIC, FCPBGA-1023
文件頁數(shù)： 65/140頁
文件大小： 1456K
代理商： MPC8567CVTAUJJA
MPC8568E/MPC8567E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 0
30
Freescale Semiconductor
Ethernet Interface and MII Management
Timing diagrams for FIFO appear in Figure 7 and Figure 8.
.
Figure 7. FIFO Transmit AC Timing Diagram
Figure 8. FIFO Receive AC Timing Diagram
8.2.2
GMII AC Timing Specifications
This section describes the GMII transmit and receive AC timing specifications.
8.2.2.1
GMII Transmit AC Timing Specifications
Table 27 provides the GMII transmit AC timing specifications.
Table 27. GMII Transmit AC Timing Specifications
At recommended operating conditions with LVDD of 3.3 V ± 5%.
Parameter/Condition
Symbol 1
Min
Typ
Max
Unit
GTX_CLK clock period
tGTX
—8.0
—
ns
GTX_CLK duty cycle
tGTXH/tGTX
45
—
55
%
GMII data TXD[7:0], TX_ER, TX_EN setup time
tGTKHDV
2.5
—
ns
GTX_CLK to GMII data TXD[7:0], TX_ER, TX_EN delay
tGTKHDX
0.5
—
5.0
ns
GTX_CLK data clock rise time (20%-80%)
tGTXR
2
—1.0
2.0
ns
GTX_CLK data clock fall time (80%-20%)
tGTXF
2
—1.0
2.0
ns
EC_GTX_CLK125 clock rise time (20%-80%)
tG125R
—1.0
2.0
ns
EC_GTX_CLK125 clock fall time (80%-20%)
tG125F
—1.0
2.0
ns
tFIT
tFITH
tFITF
tFITDX
TXD[7:0]
TX_EN
GTX_CLK
TX_ER
tFITDV
tFITR
tFIR
tFIRH
tFIRF
tFIRR
RX_CLK
RXD[7:0]
RX_DV
RX_ER
valid data
tFIRDX
tFIRDV
相關PDF資料
PDF描述
MPC8568CVTAQGGA 32-BIT, 1000 MHz, RISC PROCESSOR, PBGA1023
MPC8568VTANGGA 32-BIT, 800 MHz, RISC PROCESSOR, PBGA1023
MPC8568CVTAUJJA 32-BIT, 1333 MHz, RISC PROCESSOR, PBGA1023
MPC8567CVTAQGGA 32-BIT, 1000 MHz, RISC PROCESSOR, PBGA1023
MPC8568ECVTAQGGA 32-BIT, 1000 MHz, RISC PROCESSOR, PBGA1023
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參數(shù)描述
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