參數(shù)資料
型號(hào): MPC9448FA
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 2/13頁
文件大小: 0K
描述: IC CLOCK BUFFER MUX 1:12 32-LQFP
標(biāo)準(zhǔn)包裝: 250
類型: 扇出緩沖器(分配),多路復(fù)用器
電路數(shù): 1
比率 - 輸入:輸出: 1:12
差分 - 輸入:輸出: 是/無
輸入: LVCMOS,LVPECL
輸出: LVCMOS
頻率 - 最大: 350MHz
電源電壓: 2.375 V ~ 3.465 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 32-LQFP
供應(yīng)商設(shè)備封裝: 32-TQFP(7x7)
包裝: 托盤
其它名稱: 800-2012
MPC9448FAIDT-ND
MPC9448 REVISION 7 DECEMBER 21, 2012
10
2012 Integrated Device Technology, Inc.
MPC9448 Data Sheet
3.3V/2.5V LVCMOS 1:12 CLOCK FANOUT BUFFER
Figure 13. Propagation Delay (tPD) Test Reference
Figure 14. Propagation Delay (tPD) Test Reference
Figure 15. Output-to-Output Skew tSK(LH, HL)
Figure 16. Output Pulse Skew (tSK(P)) Test Reference
Figure 17. Output Duty Cycle (DC)
Figure 18. Output Transition Time Test Reference
Figure 19. Cycle-to-Cycle Jitter
Figure 20. Setup and Hold Time (tS, tH) Test Reference
VCC
GND
PCLK
QX
PCLK
VPP
tP(LH)
tP(HL)
VCC
VCC2
GND
VCC
VCC2
GND
CCLK
QX
tP(LH)
tP(HL)
The pin-to-pin skew is defined as the worst case differ-
ence in propagation delay between any similar delay
path within a single device.
VCC
VCC2
GND
VCC
VCC2
GND
tSK(LH)
tSK(HL)
VCC
VCC2
GND
VCC
VCC2
GND
tP(LH)
CCLK
QX
tP(HL)
tSK(P) = | tPLH – tPHL |
The time from the output controlled edge to the non-
controlled edge, divided by the time between output
controlled edges, expressed as a percentage.
VCC
VCC2
GND
tP
T0
DC = (tP T0 x 100%)
tF
tR
VCC=3.3 V VCC=2.5 V
2.4
1.8 V
0.55
0.6 V
The variation in cycle time of a signal between ad-
jacent cycles, over a random sample of adjacent
cycle pairs.
TN
TJIT(CC) = |TN-TN+1|
TN+1
VCC
VCC2
GND
VCC
VCC2
GND
tS
CCLK
PCLK
CLK_STOP
tH
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PDF描述
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參數(shù)描述
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