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參數(shù)資料
| 型號： | MSM66Q577-TB |
| 廠商： | OKI ELECTRIC INDUSTRY CO LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 30 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, TQFP-100 |
| 文件頁數(shù)： | 19/37頁 |
| 文件大小： | 327K |
| 代理商： | MSM66Q577-TB |
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PEDL66579-03
1Semiconductor
MSM66579 Family
26/37
External data memory control
MSM66577L/579L (V
DD = 2.4 to 3.6 V, Ta = –30 to +70°C)
MSM66Q577L/Q579L (V
DD = 2.7 to 3.3 V, Ta = –30 to +70°C)
Parameter
Symbol
Condition
Min.
Max.
Unit
Cycle time
t
cyc
f
OSC = 30 MHz
71.4
—
Clock pulse width (HIGH level)
tφWH
28
—
Clock pulse width (LOW level)
tφWL
28
—
ALE pulse width
t
AW
2 t
φ – 18
—
RD pulse width
t
RW
2 t
φ – 18
—
WR pulse width
t
WW
2 t
φ – 18
—
RD pulse delay time
t
RAD
t
φ – 6
t
φ +6
WR pulse delay time
t
WAD
t
φ – 6
t
φ +6
Low address setup time
t
ALS
2 t
φ – 12
2 t
φ
Low address hold time
t
ALH
t
φ – 6
t
φ +6
High address setup time
t
AHS
3 t
φ – 12
3 t
φ +12
High address hold time
t
AHH
t
φ – 6
t
φ +6
Read data setup time
t
RS
48
—
Read data hold time
t
RH
0t
φ – 6
Write data setup time
t
WS
2t
φ – 24
—
Write data hold time
t
WH
C
L = 50 pF
t
φ – 6
t
φ + 6
ns
Note: t
φ = t
cyc/2
t
cyc
DIN0 to 7
RAP8 to 19
A
tφ
WH
CPUCLK
RD
A8 to A19
AD0 to AD7
ALE
RAP0 to 7
DOUT0 to 7
WR
A8 to A19
AD0 to AD7
RAP0 to 7
Bus timing during no wait cycle time
RAP8 to 19
tφ
WL
t
AW
t
RAD
t
RW
t
ALS
t
ALH
t
RS
t
RH
t
AHH
t
AHS
t
WAD
t
WW
t
WH
t
WS
t
ALS
t
ALH
t
AHH
t
AHS
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