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參數(shù)資料
| 型號： | MSP430F4617IPZR |
| 廠商： | TEXAS INSTRUMENTS INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 8 MHz, RISC MICROCONTROLLER, PQFP100 |
| 封裝： | GREEN, PLASTIC, LQFP-100 |
| 文件頁數(shù)： | 48/95頁 |
| 文件大?。?/td> | 1514K |
| 代理商： | MSP430F4617IPZR |
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MSP430x461x1, MSP430x461x
MIXED SIGNAL MICROCONTROLLER
52
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
electrical characteristics over recommended operating free-air temperature (unless otherwise
noted) (continued)
12-bit ADC, built-in reference
PARAMETER
TEST CONDITIONS
VCC
MIN
TYP
MAX
UNIT
V
Positive built-in
reference voltage
REF2_5V = 1 for 2.5 V,
IVREF+max ≤ IVREF+≤ IVREF+min
3 V
2.4
2.5
2.6
V
VREF+
reference voltage
output
REF2_5V = 0 for 1.5 V,
IVREF+max ≤ IVREF+≤ IVREF+min
2.2 V/3 V
1.44
1.5
1.56
V
AV
AVCC minimum
voltage, Positive
REF2_5V = 0, IVREF+max ≤ IVREF+
≤ IVREF+min
2.2
V
AVCC(min)
voltage, Positive
built-in reference
REF2_5V = 1, IVREF+min ≥ IVREF+ ≥ 0.5mA
2.8
V
built in reference
active
REF2_5V = 1, IVREF+min ≥ IVREF+ ≥ 1mA
2.9
I
Load current out of
2.2 V
0.01
0.5
mA
IVREF+
Load current out of
VREF+ terminal
3 V
0.01
1
mA
IVREF+ = 500 A +/ 100 A,
Analog input voltage 0 75 V;
2.2 V
±2
LSB
I
Load-current
regulation V
Analog input voltage ~0.75 V;
REF2_5V = 0
3 V
±2
LSB
IL(VREF)+
regulation VREF+
terminal
IVREF+ = 500 A ± 100 A,
Analog input voltage ~1.25 V,
REF2_5V = 1
3 V
±2
LSB
I
Load current
regulation V
IVREF+ =100 A → 900 A,
C
5
F ax 05xV
3V
20
ns
IDL(VREF) +
regulation VREF+
terminal
CVREF+=5 F, ax ~0.5 x VREF+,
Error of conversion result
≤ 1 LSB
3 V
20
ns
CVREF+
Capacitance at pin
VREF+ (see Note 1)
REFON =1,
0 mA
≤ IVREF+ ≤ IVREF+max
2.2 V/3 V
5
10
F
TREF+
Temperature
coefficient of built-in
reference
IVREF+ is a constant in the range of
0 mA
≤ IVREF+ ≤ 1 mA
2.2 V/3 V
±100 ppm/°C
tREFON
Settle time of internal
reference voltage
(see Figure 23 and
Note 2)
IVREF+ = 0.5 mA, CVREF+ = 10 F,
VREF+ = 1.5 V, VAVCC = 2.2 V
17
ms
NOTES:
1. The internal buffer operational amplifier and the accuracy specifications require an external capacitor. All INL and DNL tests uses
two capacitors between pins VREF+ and AVSS and VREF/VeREF and AVSS: 10 F tantalum and 100 nF ceramic.
2. The condition is that the error in a conversion started after tREFON is less than ±0.5 LSB. The settling time depends on the external
capacitive load.
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