參數(shù)資料
型號(hào)： N74F109D-T
廠商： NXP SEMICONDUCTORS
元件分類： 鎖存器
英文描述： Positive J-Knot positive edge-triggered flip-flops - Description: Dual J-/K Flip-Flop with Set and Reset; Positive-Edge Trigger ; F<sub>max</sub>: 125 MHz; Logic switching levels: TTL ; Number of pins: 14 ; Output drive capability: -1/+20 mA ; Propagation delay: 6.2 ns; Voltage: 4.5-5.5 V
中文描述： F/FAST SERIES, DUAL POSITIVE EDGE TRIGGERED J-KBAR FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16
封裝： 3.9 MM, PLASTIC, SOT109-1, SO-16
文件頁(yè)數(shù)： 6/10頁(yè)
文件大?。?/td> 95K
代理商： N74F109D-T
Philips Semiconductors
Product specification
74F109
Postive J-K positive edge-triggered flip-flops
October 23, 1990
5
AC WAVEFORMS
For all waveforms, VM = 1.5V.
The shaded areas indicate when the input is permitted to change for predictable output performance.
VM
CPn
VM
tsu(H)
th(H)
Jn, Kn
Qn
VM
tw(H)
1/fmax
tsu(L)
th(L)
VM
tPLH
Qn
tw(L)
tPHL
tPLH
SF00139
Waveform 1. Propagation Delay for Data to Output, Data Setup
Time and Hold Times, and Clock Width,and Maximum
Clock Frequency
VM
RDn
VM
Qn
VM
tPLH
Qn
tw(L)
tPHL
tPLH
SDn
VM
tw(L)
SF00050
Waveform 2. Propagation Delay for Set and Reset to Output,
Set and Reset Pulse Width
SDn or RDn
VM
trec
CPn
SF00051
Waveform 3. Recovery Timer for Set or Reset to Clock
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PDF描述
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參數(shù)描述
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