參數(shù)資料
型號： N74F51D
廠商： NXP Semiconductors N.V.
元件分類： 通用總線功能
英文描述： Dual 2-wide 2-input, 2-wise 3-input AND-OR-invert gate
封裝： N74F51D<SOT108-1 (SO14)|<<http://www.nxp.com/packages/SOT108-1.html<1<week 5, 2004,;N74F51D<SOT108-1 (SO14)|<<http://www.nxp.com/packages/SOT108-1.html<1<week 5, 20
文件頁數(shù)： 2/8頁
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代理商： N74F51D
Philips Semiconductors
Product specification
74F51
Dual 2-wide 2-input, 2-wide 3-input AND-OR-invert gate
2
March 3, 1989
853–0054 95962
TYPE
TYPICAL
PROPAGATION
DELAY
3.0ns
TYPICAL
SUPPLY CURRENT
(TOTAL)
3.5mA
74F51
ORDERING INFORMATION
DESCRIPTION
COMMERCIAL RANGE
V
CC
= 5V
±
10%,
T
amb
= 0
°
C to +70
°
C
N74F51N
N74F51D
PKG DWG #
14-pin plastic DIP
14-pin plastic SO
SOT27-1
SOT108-1
PIN CONFIGURATION
14
13
12
11
10
9
8
7
6
5
4
3
2
1
GND
V
CC
D0e
D0d
Q0
D0f
D0c
D0b
D0a
D1a
Q1
D1b
D1c
D1d
SF00085
INPUT AND OUTPUT LOADING AND FAN-OUT TABLE
PINS
Dna, Dnb, Dnc, Dnd, Dne, Dnf
Data inputs
Q0, Q1
Data outputs
NOTE:
One (1.0) FAST unit load is defined as: 20
μ
A in the High state and 0.6mA in the Low state.
DESCRIPTION
74F (U.L.) HIGH/LOW
1.0/1.0
50/33
LOAD VALUE HIGH/LOW
20
μ
A/0.6mA
1.0mA/20mA
LOGIC SYMBOL
D1a
D0f
D0b D0c D0d
D1b D1c
D0e
Q0
Q1
8
6
12
13
9
10
11
2
3
4
V
= Pin 14
GND = Pin 7
SF00086
D0a
1
D1d
5
IEC/IEEE SYMBOL
SF00087
1
8
6
9
10
11
13
12
1
2
3
4
5
1
&
&
&
&
LOGIC DIAGRAM
V
= Pin 14
GND = Pin 7
SF00088
1
12
13
2
3
D0a
D0b
D0c
D1a
D1b
Q0
8
9
10
11
D0d
D0e
D0f
4
5
D1c
D1d
Q1
6
FUNCTION TABLE FOR 3-INPUT GATES
INPUTS
D0a
D0b
D0c
H
H
H
X
X
X
All other combinations
NOTES:
H = High voltage level
L
= Low voltage level
X = Don’t care
OUTPUT
Q0
L
L
H
D0d
X
H
D0e
X
H
D0f
X
H
FUNCTION TABLE FOR 2-INPUT GATES
INPUTS
D1a
D1b
H
H
X
X
All other combinations
NOTES:
H = High voltage level
L
= Low voltage level
X = Don’t care
OUTPUT
Q1
L
L
H
D1c
X
H
D1d
X
H
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PDF描述
N74F51N Dual 2-wide 2-input, 2-wise 3-input AND-OR-invert gate
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