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參數(shù)資料
| 型號： | OR2C12A-6BA256 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 元件分類： | FPGA |
| 英文描述： | Field-Programmable Gate Arrays |
| 中文描述： | 現(xiàn)場可編程門陣列 |
| 文件頁數(shù)： | 117/192頁 |
| 文件大小： | 3148K |
| 代理商： | OR2C12A-6BA256 |
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Data Sheet
ORCA Series 2 FPGAs
June 1999
30
Lucent Technologies Inc.
Programmable Input/Output Cells (continued)
5-2843(F).r8
Figure 26. PIC Architecture
DT
PA
PB
PC
PD
PXL[1]
PXL[0]
PX2[2]
PX2[3]
PX2[0]
PX2[1]
PX1[0]
PX1[1]
PX1[2]
PX1[3]
PXH[1]
PXH[2]
PXH[3]
PXH[0]
B
A
C
D
FE
G
Q
PXL[0]
PXL[1]
PX2[0]
PX2[1]
PX2[2]
PX2[3]
PX1[0]
PX1[1]
PX1[2]
PX1[3]
PXH[1]
PXH[2]
PXH[3]
PXH[0]
B
A
C
D
TS
0
OU
T0
IN
0
DO
UT
0
TS
1
OU
T1
IN
1
DO
UT
1
TS
3
OU
T3
IN
3
DO
UT
3
TS
2
OU
T2
IN
2
DO
UT
2
PIC DETAIL
BI
D
I3
F
O
N
O
LLDRV
M
I
L
J
K
N
D
C
P
Q
M
B
IDIH3
B
IDIH2
B
IDIH1
B
IDIH0
BI
D
I2
BI
D
I1
BI
D
I0
LL
IN
3
LL
IN
2
LL
IN
1
LL
IN
0
P
VX
L
[3
]
VX
L
[2
]
VX
L
[1
]
VX
L
[0
]
VX
1
[7
]
VX
1
[6
]
VX
1
[5
]
VX
1
[4
]
VX
1
[3
]
VX
1
[2
]
VX
1
[1
]
VX
1
[0
]
DO
UT
[3
]
DO
UT
[2
]
DO
UT
[1
]
XS
W
[3
]
XS
W
[2
]
XS
W
[1
]
XS
W
[0
]
XS
W
[4
]
DO
UT
[0
]
CK
T
VXH
[3
]
VXH
[2
]
VXH
[1
]
VXH
[0
]
VX
4
[7
]
VX
4
[6
]
VX
4
[5
]
VX
4
[4
]
P
D
IN
T
B
[3
]
P
D
IN
T
B
[2
]
P
D
IN
T
B
[1
]
P
D
IN
T
B
[0
]
VX
4
[3
]
VX
4
[2
]
VX
4
[1
]
VX
4
[0
]
PLC-PIC Routing Resources
There is no direct connection between the inter-PIC
lines and the PLC lines. All connections to/from the
PLC must be done through the connecting lines which
are perpendicular to the lines in the PIC. The use of
perpendicular and parallel lines will be clearer if the
PLC and PIC architectures (Figure 23 and Figure 26)
are placed side by side. Twenty-nine lines in the PLC
can be connected to the 15 lines in the PIC.
Multiple connections between the PIC PX1 lines and
the PLC X1 lines are available. These allow buses
placed in any arbitrary order on the I/O pads to be
unscrambled when placed on the PLC X1 lines. Con-
nections are also available between the PIC PX2 lines
and the PLC X1 lines.
There are eight tridirectional (four TRIDI/four TRIDIH)
buffers in each PIC; they can do the following:
s
Drive a signal from an I/O pad onto one of the adja-
cent PLC’s XL or XH lines
s
Drive a signal from an I/O pad onto one of the two
PXL or four PXH lines in the PIC
s
Drive a signal from the PLC XL or XH lines onto one
of the two PXL or four PXH lines in the PIC
s
Drive a signal from the PIC PXL or PXH lines onto
one of the PLC XL or XH lines
相關(guān)PDF資料 |
PDF描述 |
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| OR2C12A-6BA352I | Field-Programmable Gate Arrays |
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參數(shù)描述 |
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| OR2C15A3BA352I-DB | 功能描述:FPGA - 現(xiàn)場可編程門陣列 Use ECP/EC or XP RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| OR2C15A3M84I-D | 功能描述:FPGA - 現(xiàn)場可編程門陣列 1600 LUT 298 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| OR2C15A3PS208I-DB | 功能描述:FPGA - 現(xiàn)場可編程門陣列 1600 LUT 298 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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