參數(shù)資料
      

      


      


      
型號(hào)：
OR2C15A-2S240I

      

      
廠商：
Electronic Theatre Controls, Inc.

      

      
英文描述：
CAP 330PF 100V 5% NP0(C0G) SMD-0805 T&R TIN/LEAD/ALLOY S-MIL-PRF-55681

      

      
中文描述：
現(xiàn)場(chǎng)可編程門陣列

      

      
文件頁(yè)數(shù)：
139/192頁(yè)

      

      
文件大小：
3148K

      

      
代理商：
OR2C15A-2S240I


      

      

      

	
      
    
    
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      50
      Lucent Technologies Inc.
      Data Sheet
      ORCA Series 2 FPGAs
      June 1999
      FPGA Configuration Modes (continued)
      Slave Serial Mode
      The slave serial mode is primarily used when multiple
      FPGAs are configured in a daisy chain. The serial
      slave serial mode is also used on the FPGA evaluation
      board which interfaces to the download cable. A device
      in the slave serial mode can be used as the lead device
      in a daisy chain. Figure 44 shows the connections for
      the slave serial configuration mode.
      The configuration data is provided into the FPGA’s DIN
      input synchronous with the configuration clock CCLK
      input. After the FPGA has loaded its configuration data,
      it retransmits the incoming configuration data on
      DOUT. CCLK is routed into all slave serial mode
      devices in parallel.
      Multiple slave FPGAs can be loaded with identical con-
      figurations simultaneously. This is done by loading the
      configuration data into the DIN inputs in parallel.
      5-4485(F)
      Figure 44. Slave Serial Configuration Schematic
      Slave Parallel Mode
      The slave parallel mode is essentially the same as the
      slave serial mode except that 8 bits of data are input on
      pins D[7:0] for each CCLK cycle. Due to 8 bits of data
      being input per CCLK cycle, the DOUT pin does not
      contain a valid bit stream for slave parallel mode. As a
      result, the lead device cannot be used in the slave
      parallel mode in a daisy-chain configuration.
      Figure 45 is a schematic of the connections for the
      slave parallel configuration mode. WR and CS0 are
      active-low chip select signals, and CS1 is an active-
      high chip select signal. These chip selects allow the
      user to configure multiple FPGAs in slave parallel
      mode using an 8-bit data bus common to all of the
      FPGAs. These chip selects can then be used to select
      the FPGA(s) to be configured with a given bit stream,
      but once an FPGA has been selected, it cannot be
      deselected until it has been completely programmed.
      5-4487(F)
      Figure 45. Slave Parallel Configuration Schematic
      MICRO-
      PROCESSOR
      OR
      DOWNLOAD
      CABLE
      M2
      M1
      M0
      HDC
      SERIES
      FPGA
      LDC
      VDD
      CCLK
      PRGM
      DOUT
      TO DAISY-
      CHAINED
      DEVICES
      DONE
      DIN
      INIT
      ORCA
      MICRO-
      PROCESSOR
      OR
      SYSTEM
      D[7:0]
      DONE
      CCLK
      CS1
      M2
      M1
      M0
      HDC
      LDC
      8
      VDD
      INIT
      PRGM
      CS0
      WR
      SERIES
      FPGA
      ORCA
      
    
      
    
    
      


      


      

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Ceramic Chip Capacitors / MIL-PRF-55681; Capacitance [nom]: 330pF; Working Voltage (Vdc)[max]: 100V; Capacitance Tolerance: +/-10%; Dielectric: Multilayer Ceramic; Temperature Coefficient: C0G (NP0); Lead Style: Surface Mount Chip; Lead Dimensions: 0805; Termination: Solder Coated SnPb; Body Dimensions: 0.080" x 0.050" x 0.055"; Container: Bag; Features: MIL-PRF-55681: M Failure Rate

      

      
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OR2C15A3BA256I-DB
功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 1600 LUT 298 I/O

 RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256

      

      
OR2C15A3BA352I-DB
功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 Use ECP/EC or XP

 RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256

      

      
OR2C15A3M84I-D
功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 1600 LUT 298 I/O

 RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256

      

      
OR2C15A3PS208I-DB
功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 1600 LUT 298 I/O

 RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256

      

      
OR2C15A3PS240I-DB
功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 1600 LUT 298 I/O

 RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256

      

      
    
    
    
	
      	
    
    
     
     
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                                    廠商
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                                    封裝
                                  
      
                                      
                                
                                
      
                                    
                                        
      
                                            
                                            
                                        
      
                                          		
                                     
                                    
                                        
      
                                          		
                                    
                                        
      
                                          		
                                    
                                        
      
                                          		
                                    
                                        
      
                                          		
                                  
      
                                  
                                   
                                      
                            
      
                             
                             
							                            
      
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