參數(shù)資料
型號： ORLI10G2BM680-DB
廠商： LATTICE SEMICONDUCTOR CORP
元件分類： FPGA
英文描述： FPGA, 1296 CLBS, 333000 GATES, PBGA680
封裝： PLASTIC, FBGA-680
文件頁數(shù)： 37/78頁
文件大?。?/td> 1689K
代理商： ORLI10G2BM680-DB
Lattice Semiconductor
ORCA ORLI10G Data Sheet
42
Figure 28 shows the Transmit (FPGA to embedded Line Interface) timing for 10G mode where PLL_TX2 is used to
align clocks across the FPGA - Core boundary. The 1.9 ns hold time shown is an approximate hold time value for
the embedded line interface. Consult the ispLEVER software, via the static timing analysis tool TRACE, for the
exact timing values. Figure 28. shows a full cycle transfer. Designers should make sure to satisfy the hold require-
ment.
Figure 28. Transmit Timing for 10G Mode with PLL for Clock Alignment (-1 Speed Grade)
0.0ns Setup
Launch
Capture
TX_CLK8_IN_BUF
1.6ns
3ns
TX_DAT_IN
Primary
FPGA Clock
Tree
Clock
Divider
PLL_TX2
Q
TX2_VCOP
TX2_FBCKI
Embedded Line Interface Core
FPGA
D
TX_CLK_IN
(644 MHz)
0.0ns
3.1ns
6.2ns
9.3ns
12.4ns
TX2_FBCKI
(Reference Clock)
3.1ns
9.3ns
FPGA Clock
1.1ns
4.2ns
7.3ns
10.4ns
13.5ns
TX_CLK8_IN_BUF
Data
Valid Data Window
0.0ns
6.2ns
12.4ns
1.9ns Hold
0.5ns
相關(guān)PDF資料
PDF描述
ORLI10G3BM680-DB FPGA, 1296 CLBS, 333000 GATES, PBGA680
ORT82G5-1BM680 FPGA, 1296 CLBS, 380000 GATES, PBGA680
ORT82G5-2BM680 FPGA, 1296 CLBS, 380000 GATES, PBGA680
ORT82G5-3BM680 FPGA, 1296 CLBS, 380000 GATES, PBGA680
OS10040280G-012 FIBER OPTIC RECEIVER, 1290-1600nm, PANEL MOUNT, FC/APC CONNECTOR
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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