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參數(shù)資料
| 型號： | P83C380 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Microcontrollers for monitors with DDC interface, auto-sync detection and sync proc(帶DDC接口，同步監(jiān)測和同步處理的監(jiān)視器微控制器) |
| 中文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PDIP42 |
| 封裝： | 0.600 INCH, PLASTIC, SOT-270-1, SDIP-42 |
| 文件頁數(shù)： | 43/84頁 |
| 文件大?。?/td> | 420K |
| 代理商： | P83C380 |
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1997 Dec 12
43
Philips Semiconductors
Product specification
Microcontrollers for monitors with DDC
interface, auto-sync detection and sync proc.
P83Cx80; P87C380
17.1.2
A
DDRESS
P
OINTER FOR
DDC I
NTERFACE
R
EGISTER
(DDCADR)
The bits of this register are all R/W.
Table 38
Address Pointer for DDC Interface Register (address 9EH)
Table 39
Description of DDCADR bits
17.1.3
DDC1 D
ATA
T
RANSMISSION
R
EGISTER
(DDCDAT)
Table 40
DDC1 Data Transmission Register (address 9FH)
Table 41
Description of DDCDAT bits
7
6
5
4
3
2
1
0
DDCADR.7
DDCADR.6
DDCADR.5
DDCADR.4
DDCADR.3
DDCADR.2
DDCADR.1
DDCADR.0
BIT
SYMBOL
DESCRIPTION
7 to 0
DDCADR.7 to DDCADR.0
Address pointer with the capability of post increment. After each access
to RAMBUF register (either by software or by hardware DDC1 interface),
the content of this register will be increased by one. It is available both in
DDC1, DDC2 (DDC2B, DDC2B+ and DDC2AB) and system operation.
7
6
5
4
3
2
1
0
DDCDAT.7
DDCDAT.6
DDCDAT.5
DDCDAT.4
DDCDAT.3
DDCDAT.2
DDCDAT.1
DDCDAT.0
BIT
SYMBOL
DESCRIPTION
7 to 0
DDCDAT.7 to DDCDAT.0
Data byte to be transmitted in DDC1 protocol.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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