- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄383734 > P9S12XEP100J1VVL (飛思卡爾半導(dǎo)體(中國(guó))有限公司) Microcontrollers PDF資料下載
參數(shù)資料
| 型號(hào)： | P9S12XEP100J1VVL |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁(yè)數(shù)： | 446/1036頁(yè) |
| 文件大?。?/td> | 3356K |
| 代理商： | P9S12XEP100J1VVL |
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Chapter 10 XGATE (S12XGATEV3)
OR
MC9S12XE-Family Reference Manual , Rev. 1.07
446
Freescale Semiconductor
Operation
RS1
|
RS2
RD
|
IMM16
RD (translates to ORL RD, #IMM16[7:0]; ORH RD, #IMM16[15:8]
RD
Performs a bit wise logical OR between two 16 bit values and stores the result in the destination
register RD.
NOTE
When using immediate addressing mode (OR RD, #IMM16), the Z-flag of
the first instruction (ORL RD, #IMM16[7:0]) is not considered by the
second instruction (ORH RD, #IMM16[15:8]).
Don’t rely on the Z-Flag.
CCR Effects
Code and CPU Cycles
Logical OR
OR
N
Z
V
C
0
—
N:
Z:
Set if bit 15 of the result is set; cleared otherwise.
Set if the result is $0000; cleared otherwise.
Refer to ORH instruction for #IMM16 operations.
0; cleared.
Not affected.
V:
C:
Source Form
Address
Mode
Machine Code
Cycles
OR RD, RS1, RS2
TRI
0
0
0
1
0
RD
RS1
RS2
1
0
P
OR RD, #IMM16
IMM8
1
0
1
0
0
RD
IMM16[7:0]
P
IMM8
1
0
1
0
1
RD
IMM16[15:8]
P
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