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參數(shù)資料
| 型號： | PEF20532 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | 2 Channel Serial Optimized Communication Controller |
| 中文描述： | 2通道串行通信控制器的優(yōu)化 |
| 文件頁數(shù)： | 255/282頁 |
| 文件大?。?/td> | 3623K |
| 代理商： | PEF20532 |
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PEB 20532
PEF 20532
Programming
Data Sheet
255
2000-09-14
Figure 61
Fragmented Reception per DMA (Example)
After the external DMA controller is initialized with the base address of receive buffer #1
and the maximum buffer size RMBS is written to SEROCCO-M, simultaneously
activated with the
’
RE
’
command, requesting of DMA transfer from the RFIFO to the
receive buffer takes place in blocks of 32 bytes (unless changed with bit field
’
RFTH
’
in
register
CCR3H
).
After four 32-byte-blocks have been transferred, the first receive buffer is filled up
completely with receive data. The SEROCCO-M indicates this by generating the RBF
interrupt.
Now the CPU has to provide the base address of the second receive buffer to the
external DMA controller and issue the
’
RE
’
command to SEROCCO-M again. This allows
the external DMA controller to continue data transfers into the second receive buffer.
After another two 32-byte-blocks have been transferred, the DMA request for the
remaining 7 bytes (including the
RSTA
byte) is generated to the external DMA controller,
follwed by the generation of the RDTE interrupt. Now the DMA transfer is completed and
software has to read the number of received bytes from the Receive Byte Count registers
RBCL
/
RBCH
.
The following figure (
Figure 62
) gives the sequence of actions from both, the
SEROCCO-M and the CPU for this example (fragmented reception of 199 bytes into two
receive buffers):
32
32
32
32
32
32
7
128
1
...
199 Bytes Payload
128
1
1st packet
fragment
2nd packet
fragment
...
Receive Buffers
in Memory
Packet
相關PDF資料 |
PDF描述 |
|---|---|
| PEB20532 | 2 Channel Serial Optimized Communication Controller |
| PEF20534 | DMA Supported Serial Communication Controller with 4 Channels |
| PEB20534 | DMA Supported Serial Communication Controller with 4 Channels |
| PEB20534H-10 | DMA Supported Serial Communication Controller with 4 Channels DSCC4 |
| PEB20534H-52 | DMA Supported Serial Communication Controller with 4 Channels DSCC4 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| PEF20532FV13XP | 制造商:Lantiq 功能描述:T/E |
| PEF20532-FV13XP | 制造商:Infineon Technologies AG 功能描述:2 CHANNEL(S), 16M BPS, SERIAL COMM CONTROLLER, PQFP100 |
| PEF20534 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:DMA Supported Serial Communication Controller with 4 Channels |
| PEF2054 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:ICs for Communications |
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