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參數(shù)資料
| 型號(hào)： | PEF20550 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 97/407頁 |
| 文件大?。?/td> | 1964K |
| 代理商： | PEF20550 |
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PEB 20550
PEF 20550
Operational Description
Semiconductor Group
97
01.96
Sub Time Slot Switching
Sub time slot positions at the PCM-interface can be selected at random, i.e. each single
PCM time slot-may contain any mixture of 2- and 4-bit sub time slots. A PCM time slot
may also contain more than one sub time slot. On the CFI however, two restrictions must
be observed:
– Each CFI time slot may contain one and one only sub time slot.
– The sub-slot position for a given bandwidth within the time slot is fixed on a per port
basis.
For more detailed information on sub-channel switching please refer to
chapter 5.4.2
.
μ
P-Transfer
Switching paths 3 and 4 of
figure 47
can be realized for all available time slots. Path 3
can be implemented by defining the corresponding CFI time slots as "
μ
P-channels" or
as "pre-processed channels".
Each single time slot can individually be declared as
"
μ
P-channel"
. If this is the case,
the
μ
P can write a static 8-bit value to a downstream time slot which is then transmitted
repeatedly in each frame until a new value is loaded. In upstream direction, the
μ
P can
read the received 8-bit value whenever required, no interrupts being generated.
The
"pre-processed channel"
option must always be applied to two consecutive time
slots. The first of these time slots must have an even time slot number. If two time- slots
are declared as "pre-processed channels", the first one can be accessed by the monitor/
feature control handler, which gives access to the frame via a 16-byte FIFO. Although
this function is mainly intended for IOM- or SLD-applications, it could also be used to
transmit or receive a "burst" of data to or from a 64-kbit/s channel. The second pre-
processed time slot, the odd one, is also accessed by the
μ
P. In downstream direction
a 4-, 6- or 8-bit static value can be transmitted. In upstream direction the received 8-bit
value can be read. Additionally, a change detection mechanism will generate an interrupt
upon a change in any of the selected 4, 6 or 8 bits.
Pre-processed channels are usually programmed after Control Memory (CM) reset
during device initialization. Resetting the CM sets all CFI time slots to unassigned
channels (CM code '0000'). Of course, pre-processed channels can also be initialized or
re-initialized in the operational phase of the device.
To program a pair of pre-processed channels the correct code for the selected handling
scheme must be written to the CM.
Figure 48
gives an overview of the available pre-
processing codes and their application. For further detail, please refer to
chapter 5.5
of
the EPIC-1 Application Manual.
Note: To operate the D-channel arbiter, an IOM-2 configuration with central-, or
decentral D-channel handling should be programmed. With the D-channel arbiter
enabled, D-channel bits are handled by the SACCO-A.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEB20550 | ICs for Communications |
| PEF20570 | DSP Embedded Line and Port Interface Controller |
| PEF20571 | DSP Embedded Line and Port Interface Controller |
| PEF2080 | S/T Bus Interface Circuit(SBC) |
| PEF22554 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PEF20550HV2.1 | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC PBX RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| PEF20550HV2.1/TR | 制造商:Lantiq 功能描述: |
| PEF2055N | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:?PCM Controller? |
| PEF2055-N | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:PCM， Other/Special/Miscellaneous |
| PEF2055NV2.1 | 功能描述:ISDN 接口 PBX RoHS:否 制造商:Texas Instruments 封裝:Tube |
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