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參數(shù)資料
| 型號(hào)： | PIC12F510-E/MS |
| 廠商： | Microchip Technology |
| 文件頁(yè)數(shù)： | 14/39頁(yè) |
| 文件大小： | 0K |
| 描述： | IC PIC MCU FLASH 1.5KB 8MSOP |
| 產(chǎn)品培訓(xùn)模塊： | Asynchronous Stimulus |
| 標(biāo)準(zhǔn)包裝： | 100 |
| 系列： | PIC® 12F |
| 核心處理器： | PIC |
| 芯體尺寸： | 8-位 |
| 速度： | 8MHz |
| 外圍設(shè)備： | POR，WDT |
| 輸入/輸出數(shù)： | 5 |
| 程序存儲(chǔ)器容量： | 1.5KB（1K x 12） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 38 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 4x8b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 8-TSSOP，8-MSOP（0.118"，3.00mm 寬） |
| 包裝： | 管件 |
| 配用： | AC162070-ND - HEADER INTRFC MPLAB ICD2 8/14P AC164325-ND - MODULE SKT FOR 8MSOP |
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21
6462AS–ATARM–03-Jun-09
AT91SAM9G10
9.2
Reset Controller
Based on two Power-on-Reset cells
Status of the last reset
– Either cold reset, first reset, soft reset, user reset, watchdog reset, wake-up reset
Controls the internal resets and the NRST pin output
9.3
Shutdown Controller
Shutdown and Wake-up logic:
– Software programmable assertion of the SHDN pin
– Deassertion Programmable on a WKUP pin level change or on alarm
9.4
General-purpose Backup Registers
Four 32-bit general-purpose backup registers
9.5
Clock Generator
Embeds the Low-power 32,768 Hz Slow Clock Oscillator
– Provides the permanent Slow Clock to the system
Embeds the Main Oscillator
– Oscillator bypass feature
– Supports 3 to 20 MHz crystals
Embeds Two PLLs
– Outputs 80 to 300 MHz clocks
– Integrates an input divider to increase output accuracy
– 1 MHz minimum input frequency
Provides SLCK, MAINCK, PLLACK and PLLBCK.
Figure 9-2.
Clock Generator Block Diagram
Power
Management
Controller
XIN
XOUT
PLLRCA
Slow Clock
SLCK
Main Clock
MAINCK
PLLA Clock
PLLACK
Control
Status
PLL and
Divider B
PLLRCB
PLLB Clock
PLLBCK
XIN32
XOUT32
Slow Clock
Oscillator
Main
Oscillator
PLL and
Divider A
Clock Generator
相關(guān)PDF資料 |
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