參數(shù)資料
型號(hào)： PIC16C715-20/P
廠商： Microchip Technology
文件頁數(shù)： 47/177頁
文件大?。?/td> 0K
描述： IC MCU OTP 2KX14 A/D 18DIP
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 25
系列： PIC® 16C
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，WDT
輸入/輸出數(shù)： 13
程序存儲(chǔ)器容量： 3.5KB（2K x 14）
程序存儲(chǔ)器類型： OTP
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 4 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x8b
振蕩器型： 外部
工作溫度： 0°C ~ 70°C
封裝/外殼： 18-DIP（0.300"，7.62mm）
包裝： 管件
配用： ISPICR1-ND - ADAPTER IN-CIRCUIT PROGRAMMING
309-1059-ND - ADAPTER 18 ZIF BD W/18SO PLUGS
DVA16XP180-ND - ADAPTER DEVICE FOR MPLAB-ICE
AC164010-ND - MODULE SKT PROMATEII DIP/SOIC
140
7593L–AVR–09/12
AT90USB64/128
Bit 2:0 – CSn2:0: Clock Select
The three clock select bits select the clock source to be used by the Timer/Counter, see Figure
If external pin modes are used for the Timer/Countern, transitions on the Tn pin will clock the
counter even if the pin is configured as an output. This feature allows software control of the
counting.
15.10.5
TCCR1C – Timer/Counter1 Control Register C
15.10.6
TCCR3C – Timer/Counter3 Control Register C
Bit 7 – FOCnA: Force Output Compare for Channel A
Bit 6 – FOCnB: Force Output Compare for Channel B
Bit 5 – FOCnC: Force Output Compare for Channel C
The FOCnA/FOCnB/FOCnC bits are only active when the WGMn3:0 bits specifies a non-PWM
mode. When writing a logical one to the FOCnA/FOCnB/FOCnC bit, an immediate compare
match is forced on the waveform generation unit. The OCnA/OCnB/OCnC output is changed
according to its COMnx1:0 bits setting. Note that the FOCnA/FOCnB/FOCnC bits are imple-
mented as strobes. Therefore it is the value present in the COMnx1:0 bits that determine the
effect of the forced compare.
A FOCnA/FOCnB/FOCnC strobe will not generate any interrupt nor will it clear the timer in Clear
Timer on Compare Match (CTC) mode using OCRnA as TOP.
The FOCnA/FOCnB/FOCnB bits are always read as zero.
Bit 4:0 – Reserved bits
These bits are reserved for future use. For ensuring compatibility with future devices, these bits
must be written to zero when TCCRnC is written.
Table 15-5.
Clock Select bit description.
CSn2
CSn1
CSn0
Description
0
No clock source. (Timer/Counter stopped)
00
1
clk
I/O/1 (no prescaling
01
0
clkI/O/8 (from prescaler)
01
1
clkI/O/64 (from prescaler)
10
0
clk
I/O/256 (from prescaler)
10
1
clkI/O/1024 (from prescaler)
1
0
External clock source on Tn pin. Clock on falling edge
1
External clock source on Tn pin. Clock on rising edge
Bit
7
6
5
4
3
210
FOC1A
FOC1B
FOC1C
–
TCCR1C
Read/write
W
R
RRR
Initial value
0
Bit
7
6
5
4
3
210
FOC3A
FOC3B
FOC3C
–
TCCR3C
Read/write
W
R
RRR
Initial value
0
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