參數(shù)資料
型號(hào)： PIC16F1512-I/SO
廠商： Microchip Technology
文件頁數(shù)： 53/348頁
文件大?。?/td> 0K
描述： IC MCU 8BIT 3.5KB FLASH 28-SOIC
標(biāo)準(zhǔn)包裝： 27
系列： PIC® XLP™ 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
連通性： I²C，LIN，SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 25
程序存儲(chǔ)器容量： 3.5KB（2K x 14）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2.3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 17x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
包裝： 管件
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PIC16(L)F1512/3
DS41624B-page 146
Preliminary
2012 Microchip Technology Inc.
16.6
Automated Capacitive Voltage
Divider
16.6.1
CONVERSION SEQUENCE
The conversion sequence can be expanded into three
stages; pre-charge time, acquisition time, and conversion.
See Figure 16-6 for basic information on the timing of
these stages.
16.6.2
PRE-CHARGE TIMER
The pre-charge stage is an optional 1-127 instruction
cycle time used to put the external ADC channel and
the internal sample and hold capacitor (CHOLD) into
preconditioned states. The pre-charge stage of
conversion is enabled by writing a non-zero value to
the ADPRE<6:0> bits of the AADPRE register. This
stage is initiated when a conversion sequence is
started by either the GO/DONE bit or a Special Event
Trigger. When initiating an ADC conversion, if the
ADPRE bits are cleared, this stage is skipped.
During the pre-charge time, CHOLD is shorted to either
VDD or VSS, depending on the value of the ADIPPOL bit
of the AADCON3 register. The port pin logic of the
selected analog channel is overridden to drive a digital
high or low out. The output polarity of this override is
determined by the ADEPPOL bit of the AADCON3
register.
When the ADOOEN bit of the AADCON3 register is set,
then the ADOUT pin is overridden during pre-charge.
This override functions the same as the channel pin
overrides, but the polarity is selected by the ADIPPOL bit.
Even though the analog channel of the pin is selected,
the analog multiplexer is forced open during the pre-
charge stage. The ADC multiplexor logic is overridden
and disabled only during the pre-charge time.
16.6.3
ACQUISITION TIMER
The acquisition time is used to either acquire the signal
or to charge share. The acquisition time counts from 1
to 127 instruction cycle times and is used to allow the
voltage on the internal sample and hold capacitor
(CHOLD) to charge or discharge from the selected
analog channel. The acquisition time of conversion is
enabled by writing a non-zero value to the
ADACQ<6:0> bits of the AADACQ register. When the
acquisition time is enabled, the time starts immediately
follow the pre-charge stage. Otherwise, the acquisition
time is initiated by either setting the GO/DONE bit or a
Special Event Trigger.
At the start of the acquisition stage, the selected ADC
channel is connected to CHOLD. This allows charge
sharing between the pre-charged channel and the
CHOLD capacitor. See Figure 16-6.
16.6.4
STARTING A CONVERSION
To enable the ADC module, the ADON bit of the
AADCON0 register must be set to a ‘1’. Setting the GO/
DONE bit of the AADCON0 register to a ‘1’ in software
or by the Special Event Trigger inputs, will start the
Analog-to-Digital conversion.
Once a conversion begins, it proceeds until complete,
while ADON is set. If ADON is cleared (disabled by
software), the conversion is halted. The GO/DONE
status bit of the AADCON0 register indicates that a
conversion is occurring, regardless of the starting trigger.
16.6.5
COMPLETION OF A CONVERSION
When the conversion is complete, the ADC module will:
Clear the GO/DONE bit
Set the ADIF Interrupt Flag bit
Update the AADRESxH and AADRESxL registers
with new conversion result
16.6.6
TERMINATING A CONVERSION
If a conversion must be terminated before completion,
the GO/DONE bit can be cleared in software. The
AADRESxH and AADRESxL registers will be updated
with the partially complete Analog-to-Digital conversion
sample. Incomplete bits will match the last bit
converted.
16.6.7
DOUBLE SAMPLE CONVERSION
Double sampling can be enabled by the ADDSEN bit of
the AADCON3 register. When this bit is set, two
conversions are completed by each initiation of the GO/
DONE bit or a Special Event Trigger. The GO/DONE bit
stays set for the duration of both conversions and can
be used to cancel a conversion early.
The first conversion is written to the AADRES0H and
AADRES0L registers.
The second conversion starts two clock cycles after the
first has completed and the GO/DONE bit remains set.
When the ADIPEN bit of AADCON3 is set, the value
used by the ADC for the ADEPPOL, ADIPPOL, and
GRDPOL bits is inverted. The value stored in those bit
locations is unchanged. All other control signals remain
unchanged from the first conversion. The result of the
second conversion is stored in the AADRES1H and
AADRES1L registers. See Figure 16-8, Figure 16-9
and Figure 16-10 for more information.
Note:
The GO/DONE bit should not be set in the
same instruction that turns on the ADC.
Note:
A device Reset forces all registers to their
Reset state. Thus, the ADC module is
turned off and any pending conversion is
terminated.
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PIC16F1512T-I/SS 功能描述:8位微控制器 -MCU 3.5KB Flash 128B RAM 10-bit ADC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
PIC16F1513-E/MV 功能描述:8位微控制器 -MCU 7KB Flash 256B RAM 10-bit ADC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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