參數(shù)資料
型號： PIC16F1526-I/PT
廠商： Microchip Technology
文件頁數(shù)： 45/94頁
文件大小： 0K
描述： MCU 14KB FLASH 768B RAM 64-TQFP
產(chǎn)品培訓模塊： Configurable Logic Cell
8-bit PIC® Microcontroller Portfolio
特色產(chǎn)品： Extreme Low Power (XLP) Microcontrollers
標準包裝： 160
系列： PIC® XLP™ 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
連通性： I²C，LIN，SPI，UART/USART
外圍設備： 欠壓檢測/復位，POR，PWM，WDT
輸入/輸出數(shù)： 54
程序存儲器容量： 14KB（8K x 14）
程序存儲器類型： 閃存
RAM 容量： 768 x 8
電壓 - 電源 (Vcc/Vdd)： 2.3 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 30x10b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-TQFP
包裝： 托盤
210
7810C–AVR–10/12
Atmel ATmega328P [Preliminary]
Figure 21-5. Data Packet Format
21.3.5
Combining Address and Data Packets into a Transmission
A transmission basically consists of a START condition, a SLA+R/W, one or more data packets
and a STOP condition. An empty message, consisting of a START followed by a STOP condi-
tion, is illegal. Note that the Wired-ANDing of the SCL line can be used to implement
handshaking between the Master and the Slave. The Slave can extend the SCL low period by
pulling the SCL line low. This is useful if the clock speed set up by the Master is too fast for the
Slave, or the Slave needs extra time for processing between the data transmissions. The Slave
extending the SCL low period will not affect the SCL high period, which is determined by the
Master. As a consequence, the Slave can reduce the TWI data transfer speed by prolonging the
SCL duty cycle.
Figure 21-6 shows a typical data transmission. Note that several data bytes can be transmitted
between the SLA+R/W and the STOP condition, depending on the software protocol imple-
mented by the application software.
Figure 21-6. Typical Data Transmission
12
78
9
Data MSB
Data LSB
ACK
Aggregate
SDA
SDA from
Transmitter
SDA from
Receiver
SCL from
Master
SLA+R/W
Data Byte
STOP, REPEATED
START or Next
Data Byte
12
7
8
9
Data Byte
Data MSB
Data LSB
ACK
SDA
SCL
START
12
78
9
Addr MSB
Addr LSB
R/W
ACK
SLA+R/W
STOP
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PDF描述
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參數(shù)描述
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