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    參數(shù)資料
    型號: PIC16F722A-E/SS
    廠商: Microchip Technology
    文件頁數(shù): 220/286頁
    文件大?。?/td> 0K
    描述: MCU 8BIT 2K FLASH XLP 28-SSOP
    標準包裝: 47
    系列: PIC® XLP™ 16F
    核心處理器: PIC
    芯體尺寸: 8-位
    速度: 20MHz
    連通性: I²C,SPI,UART/USART
    外圍設備: 欠壓檢測/復位,POR,PWM,WDT
    輸入/輸出數(shù): 25
    程序存儲器容量: 3.5KB(2K x 14)
    程序存儲器類型: 閃存
    RAM 容量: 128 x 8
    電壓 - 電源 (Vcc/Vdd): 1.8 V ~ 5.5 V
    數(shù)據(jù)轉(zhuǎn)換器: A/D 11x8b
    振蕩器型: 內(nèi)部
    工作溫度: -40°C ~ 125°C
    封裝/外殼: 28-SSOP(0.209",5.30mm 寬)
    包裝: 托盤
    第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁當前第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁
    2010-2012 Microchip Technology Inc.
    DS41417B-page 39
    PIC16(L)F722A/723A
    4.3
    Interrupts During Sleep
    Some interrupts can be used to wake from Sleep. To
    wake from Sleep, the peripheral must be able to
    operate without the system clock. The interrupt source
    must have the appropriate interrupt enable bit(s) set
    prior to entering Sleep.
    On waking from Sleep, if the GIE bit is also set, the
    processor will branch to the interrupt vector. Otherwise,
    the processor will continue executing instructions after
    the SLEEP instruction. The instruction directly after the
    SLEEP instruction will always be executed before
    branching to the ISR. Refer to Section 19.0 “Power-
    Down Mode (Sleep)” for more details.
    4.4
    INT Pin
    The
    external
    interrupt,
    INT
    pin,
    causes
    an
    asynchronous, edge-triggered interrupt. The INTEDG bit
    of the OPTION register determines on which edge the
    interrupt will occur. When the INTEDG bit is set, the
    rising edge will cause the interrupt. When the INTEDG
    bit is clear, the falling edge will cause the interrupt. The
    INTF bit of the INTCON register will be set when a valid
    edge appears on the INT pin. If the GIE and INTE bits
    are also set, the processor will redirect program
    execution to the interrupt vector. This interrupt is
    disabled by clearing the INTE bit of the INTCON register.
    4.5
    Context Saving
    When an interrupt occurs, only the return PC value is
    saved to the stack. If the ISR modifies or uses an
    instruction that modifies key registers, their values
    must be saved at the beginning of the ISR and restored
    when the ISR completes. This prevents instructions
    following the ISR from using invalid data. Examples of
    key registers include the W, STATUS, FSR and
    PCLATH registers.
    The code shown in Example 4-1 can be used to do the
    following.
    Save the W register
    Save the STATUS register
    Save the PCLATH register
    Execute the ISR program
    Restore the PCLATH register
    Restore the STATUS register
    Restore the W register
    Since most instructions modify the W register, it must
    be saved immediately upon entering the ISR. The
    SWAPF instruction is used when saving and restoring
    the W and STATUS registers because it will not affect
    any bits in the STATUS register. It is useful to place
    W_TEMP in shared memory because the ISR cannot
    predict which bank will be selected when the interrupt
    occurs.
    The processor will branch to the interrupt vector by
    loading the PC with 0004h. The PCLATH register will
    remain unchanged. This requires the ISR to ensure
    that the PCLATH register is set properly before using
    an instruction that causes PCLATH to be loaded into
    details on PC operation.
    EXAMPLE 4-1:
    SAVING W, STATUS AND PCLATH REGISTERS IN RAM
    Note:
    The microcontroller does not normally
    require saving the PCLATH register.
    However, if computed GOTO’s are used,
    the PCLATH register must be saved at the
    beginning of the ISR and restored when
    the ISR is complete to ensure correct
    program flow.
    MOVWFW_TEMP
    ;Copy W to W_TEMP register
    SWAPFSTATUS,W
    ;Swap status to be saved into W
    ;Swaps are used because they do not affect the status bits
    BANKSELSTATUS_TEMP
    ;Select regardless of current bank
    MOVWFSTATUS_TEMP
    ;Copy status to bank zero STATUS_TEMP register
    MOVF
    PCLATH,W
    ;Copy PCLATH to W register
    MOVWF
    PCLATH_TEMP
    ;Copy W register to PCLATH_TEMP
    :
    :(ISR)
    ;Insert user code here
    :
    BANKSELSTATUS_TEMP
    ;Select regardless of current bank
    MOVF
    PCLATH_TEMP,W ;
    MOVWF
    PCLATH
    ;Restore PCLATH
    SWAPFSTATUS_TEMP,W
    ;Swap STATUS_TEMP register into W
    ;(sets bank to original state)
    MOVWFSTATUS
    ;Move W into STATUS register
    SWAPFW_TEMP,F
    ;Swap W_TEMP
    SWAPFW_TEMP,W
    ;Swap W_TEMP into W
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