參數(shù)資料
型號(hào)： PIC16F785-I/P
廠(chǎng)商： Microchip Technology
文件頁(yè)數(shù)： 135/206頁(yè)
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 2KX14 20DIP
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 22
系列： PIC® 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 17
程序存儲(chǔ)器容量： 3.5KB（2K x 14）
程序存儲(chǔ)器類(lèi)型： 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 14x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-DIP（0.300"，7.62mm）
包裝： 管件
產(chǎn)品目錄頁(yè)面： 639 (CN2011-ZH PDF)
配用： AC162060-ND - HEADER INTRFC MPLAB ICD2 20PIN
AC164039-ND - MODULE SKT PROMATE II 20DIP/SOIC
DM163029-ND - BOARD PICDEM FOR MECHATRONICS
ACICE0203-ND - MPLABICE 20P 300 MIL ADAPTER
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PIC16F785/HV785
DS41249E-page 32
2008 Microchip Technology Inc.
3.7.1
FAIL-SAFE CONDITION CLEARING
The
Fail-Safe condition is cleared after a Reset, the
execution of a SLEEP instruction, or a modification of
the SCS bit. While in Fail-Safe condition, the
PIC16F785/HV785 uses the internal oscillator as the
system clock source. The IRCF bits in the OSCCON
Register can be modified to adjust the internal oscillator
frequency without exiting the Fail-Safe condition.
The Fail-Safe condition must be cleared before the
OSFIF flag can be cleared.
FIGURE 3-9:
FSCM TIMING DIAGRAM
3.7.2
RESET OR WAKE-UP FROM SLEEP
The FSCM is designed to detect oscillator failure at any
point after the device has exited a Reset or Sleep
condition and the Oscillator Start-up Timer (OST) has
expired. If the external clock is EC or RC mode,
monitoring will begin immediately following these
events.
For LP, XT or HS mode, the external oscillator may
require a start-up time considerably longer than the
FSCM sample clock time; a false clock failure may be
detected (see Figure 3-9). To prevent this, the internal
oscillator is automatically configured as the system
clock and functions until the external clock is stable (the
OST has timed out). This is identical to Two-Speed
Start-up mode. Once the external oscillator is stable,
the LFINTOSC returns to its role as the FSCM source.
OSCFIF
CM Output
System
Clock
Output
Sample Clock
Failure
Detected
Oscillator
Failure
Note:
The system clock is normally at a much higher frequency than the sample clock. The relative frequencies in
this example have been chosen for clarity.
(Q)
CM Test
Note:
Due to the wide range of oscillator start-up
times, the Fail-Safe circuit is not active
during oscillator start-up (i.e., after exiting
Reset or Sleep). After an appropriate
amount of time, the user should check the
OSTS bit in the OSCCON Register to ver-
ify the oscillator start-up and system clock
switchover has successfully completed.
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