參數(shù)資料
型號： PIC16F87T-E/ML
廠商： Microchip Technology
文件頁數(shù)： 127/200頁
文件大?。?/td> 0K
描述： IC MCU FLASH 4KX14 EEPROM 28QFN
標(biāo)準(zhǔn)包裝： 1,600
系列： PIC® 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 16
程序存儲器容量： 7KB（4K x 14）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 256 x 8
RAM 容量： 368 x 8
電壓 - 電源 (Vcc/Vdd)： 4 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 28-VQFN 裸露焊盤
包裝： 帶卷 (TR)
配用： XLT28QFN3-ND - SOCKET TRAN ICE 18DIP/28QFN
AC164033-ND - ADAPTER 28QFN TO 18DIP
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁當(dāng)前第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁
212
8008H–AVR–04/11
ATtiny48/88
22.8
Two-Wire Serial Interface Characteristics
The following data is based on simulations and characterisations. Parameters listed in Table 22-7 are not tested in produc-
tion. Symbols refer to Figure 22-3.
Notes:
1. f
CK = CPU clock frequency.
Figure 22-3. Two-Wire Serial Bus Timing
Table 22-7.
Two-Wire Serial Interface Characteristics
Symbol
Parameter
Condition
Min
Max
Unit
V
IL
Input Low voltage
-0.5
0.3 V
CC
V
VIH
Input High voltage
0.7 VCC
VCC + 0.5
V
VHYS
Hysteresis of Schmitt-trigger inputs
VCC
2.7V
0.05 VCC
–
V
CC < 2.7V
0
VOL
Output Low voltage
3mA sink current
0
0.4
V
tSP
Spikes suppressed by input filter
0
50
ns
f
SCL
SCL clock frequency (1)
f
CK > max(16fSCL, 250kHz)
0
400
kHz
tHD:STA
Hold time (repeated) START Condition
0.6
–
s
tLOW
Low period of SCL clock
1.3
–
s
t
HIGH
High period of SCL clock
0.6
–
s
tSU:STA
Set-up time for repeated START condition
0.6
–
s
tHD:DAT
Data hold time
00.9
s
t
SU:DAT
Data setup time
100
–
ns
tSU:STO
Setup time for STOP condition
0.6
–
s
t
BUF
Bus free time between STOP and START condition
1.3
–
s
tSU;STA
tLOW
tHIGH
tLOW
tof
tHD;STA
tHD;DAT
tSU;DAT
tSU;STO
tBUF
SCL
SDA
tr
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