參數(shù)資料
型號： PIC16HV616-I/SL
廠商： Microchip Technology
文件頁數(shù)： 9/44頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 2KX14 14SOIC
產(chǎn)品培訓模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標準包裝： 57
系列： PIC® 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 20MHz
外圍設(shè)備： 欠壓檢測/復位，POR，WDT
輸入/輸出數(shù)： 11
程序存儲器容量： 3.5KB（2K x 14）
程序存儲器類型： 閃存
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 14-SOIC（0.154"，3.90mm 寬）
包裝： 管件
產(chǎn)品目錄頁面： 639 (CN2011-ZH PDF)
配用： AC162083-ND - HEADER MPLAB ICD2 PIC16F616 8/14
XLT14SO-1-ND - SOCKET TRANSITION 14SOIC 150/208
2009 Microchip Technology Inc.
DS41288F-page 17
PIC16F610/616/16HV610/616
TABLE 2-2:
PIC16F610/616/16HV610/616 SPECIAL FUNCTION REGISTERS SUMMARY BANK 1
Addr
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR, BOR
Page
Bank 1
80h
INDF
Addressing this location uses contents of FSR to address data memory (not a physical register)
xxxx xxxx
81h
OPTION_REG
RAPU
INTEDG
T0CS
T0SE
PSA
PS2
PS1
PS0
1111 1111
82h
PCL
Program Counter’s (PC) Least Significant Byte
0000 0000
83h
STATUS
IRP(1)
RP1(1)
RP0
TO
PD
ZDC
C
0001 1xxx
84h
FSR
Indirect Data Memory Address Pointer
xxxx xxxx
85h
TRISA
—
TRISA5
TRISA4
TRISA3
TRISA2
TRISA1
TRISA0
--11 1111
86h
—
Unimplemented
—
87h
TRISC
—
TRISC5
TRISC4
TRISC3
TRISC2
TRISC1
TRISC0
--11 1111
88h
—
Unimplemented
—
89h
—
Unimplemented
—
8Ah
PCLATH
—
Write Buffer for upper 5 bits of Program Counter
---0 0000
8Bh
INTCON
GIE
PEIE
T0IE
INTE
RAIE
T0IF
INTF
RAIF
0000 0000
8Ch
PIE1
—ADIE(3)
CCP1IE(3)
C2IE
C1IE
—TMR2IE(3)
TMR1IE
-000 0-00
8Dh
—
Unimplemented
—
8Eh
PCON
—
—POR
BOR
---- --qq
8Fh
—
Unimplemented
—
90h
OSCTUNE
—
TUN4
TUN3
TUN2
TUN1
TUN0
---0 0000
91h
ANSEL
ANS7
ANS6
ANS5
ANS4
ANS3(3)
ANS2(3)
ANS1
ANS0
1111 1111
92h
PR2(3)
Timer2 Module Period Register
1111 1111
93h
—
Unimplemented
—
94h
—
Unimplemented
—
95h
WPUA
—
WPUA5
WPUA4
—
WPUA2
WPUA1
WPUA0
--11 -111
96h
IOCA
—
IOCA5
IOCA4
IOCA3
IOCA2
IOCA1
IOCA0
--00 0000
97h
—
Unimplemented
—
98h
—
Unimplemented
—
99h
SRCON0
SR1
SR0
C1SEN
C2REN
PULSS
PULSR
—
SRCLKEN
0000 00-0
9Ah
SRCON1
SRCS1
SRCS0
—
00-- ----
9Bh
—
Unimplemented
—
9Ch
—
Unimplemented
—
9Dh
—
Unimplemented
—
9Eh
ADRESL(3,4)
Least Significant 2 bits of the left shifted result or 8 bits of the right shifted result
xxxx xxxx
9Fh
ADCON1(3)
—
ADCS2
ADCS1
ADCS0
—
-000 ----
Legend:
– = Unimplemented locations read as ‘0’, u = unchanged, x = unknown, q = value depends on condition, shaded = unimplemented
Note
1:
IRP and RP1 bits are reserved, always maintain these bits clear.
2:
RA3 pull-up is enabled when MCLRE is ‘1’ in the Configuration Word register.
3:
PIC16F616/16HV616 only.
4:
Read-only Register.
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