參數(shù)資料
型號： PIC16LF628-04I/SS
廠商： Microchip Technology
文件頁數(shù)： 129/170頁
文件大?。?/td> 0K
描述： IC MCU FLASH 2KX14 COMP 20SSOP
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 67
系列： PIC® 16F
核心處理器： PIC
芯體尺寸： 8-位
速度： 4MHz
連通性： UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 16
程序存儲器容量： 3.5KB（2K x 14）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 128 x 8
RAM 容量： 224 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SSOP（0.209"，5.30mm 寬）
包裝： 管件
2003 Microchip Technology Inc.
Preliminary
DS40300C-page 59
PIC16F62X
10.0 VOLTAGE REFERENCE
MODULE
The Voltage Reference is a 16-tap resistor ladder
network that provides a selectable voltage reference.
The resistor ladder is segmented to provide two ranges
of V
REF values and has a power-down function to
conserve power when the reference is not being used.
The VRCON register controls the operation of the
reference as shown in Figure 10-1. The block diagram
is given in Figure 10-1.
10.1
Configuring the Voltage Reference
The Voltage Reference can output 16 distinct voltage
levels for each range.
The equations used to calculate the output of the
Voltage Reference are as follows:
if V
RR = 1: VREF = (VR<3:0>/24) x VDD
if V
RR = 0: VREF = (VDD x 1/4) + (VR<3:0>/32) x
V
DD
The setting time of the Voltage Reference must be
considered when changing the V
REF output
(Table 17-2). Example 10-1 shows an example of how
to configure the Voltage Reference for an output
voltage of 1.25V with V
DD = 5.0V.
REGISTER 10-1:
VRCON REGISTER (ADDRESS: 9Fh)
FIGURE 10-1:
VOLTAGE REFERENCE BLOCK DIAGRAM
R/W-0
U-0
R/W-0
VREN
VROE
VRR
—VR3
VR2
VR1
VR0
bit 7
bit 0
bit 7
V
REN: VREF Enable
1
= VREF circuit powered on
0
= VREF circuit powered down, no IDD drain
bit 6
V
ROE: VREF Output Enable
1
= VREF is output on RA2 pin
0
= V
REF is disconnected from RA2 pin
bit 5
V
RR: VREF Range selection
1
= Low Range
0
= High Range
bit 4
Unimplemented: Read as '0'
bit 3-0
V
R<3:0>: VREF value selection 0
≤ VR [3:0] ≤ 15
When V
RR = 1: VREF = (VR<3:0>/ 24) * VDD
When V
RR = 0: VREF = 1/4 * VDD + (VR<3:0>/ 32) * VDD
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
’1’ = Bit is set
’0’ = Bit is cleared
x = Bit is unknown
Note
1: R is defined in Table 17-2.
Vrr
8R
Vr3
Vr0
(From VRCON<3:0>)
16-1 Analog Mux
8R
R
V
REN
Vref
16 Stages
V
DD
V
SS
V
SS
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