參數資料
型號： PIC17C752-33/L
廠商： Microchip Technology
文件頁數： 122/159頁
文件大小： 0K
描述： IC MCU OTP 8KX16 A/D PWM 68PLCC
產品培訓模塊： Asynchronous Stimulus
標準包裝： 19
系列： PIC® 17C
核心處理器： PIC
芯體尺寸： 8-位
速度： 33MHz
連通性： I²C，SPI，UART/USART
外圍設備： 欠壓檢測/復位，POR，PWM，WDT
輸入/輸出數： 50
程序存儲器容量： 16KB（8K x 16）
程序存儲器類型： OTP
RAM 容量： 454 x 8
電壓 - 電源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
數據轉換器： A/D 12x10b
振蕩器型： 外部
工作溫度： 0°C ~ 70°C
封裝/外殼： 68-LCC（J 形引線）
包裝： 管件
配用： AC164308-ND - MODULE SKT FOR PM3 68PLCC
DVA17XL681-ND - DEVICE ADAPTER FOR PIC17C752
DM173001-ND - KIT DEVELOPMENT PICDEM17
AC174007-ND - MODULE SKT PROMATEII 68PLCC
AC164024-ND - ADAPTER PICSTART PLUS 68PLCC
PIC17C7XX
DS30289B-page 64
2000 Microchip Technology Inc.
8.3
Table Reads
The table read allows the program memory to be read.
This allows constants to be stored in the program mem-
ory space and retrieved into data memory when
needed. Example 8-2 reads the 16-bit value at program
memory address TBLPTR. After the dummy byte has
been read from the TABLATH, the TABLATH is loaded
with the 16-bit data from program memory address
TBLPTR and then increments the TBLPTR value. The
first read loads the data into the latch and can be con-
sidered a dummy read (unknown data loaded into ’f’).
INDF0 should be configured for either auto-increment
or auto-decrement.
EXAMPLE 8-2:
TABLE READ
FIGURE 8-7:
TABLRD
TIMING
FIGURE 8-8:
TABLRD
TIMING (CONSECUTIVE TABLRD INSTRUCTIONS)
MOVLW
HIGH (TBL_ADDR) ; Load the Table
MOVWF
TBLPTRH
;
address
MOVLW
LOW (TBL_ADDR)
;
MOVWF
TBLPTRL
;
TABLRD
0, 1, DUMMY
; Dummy read,
;
Updates TABLATH
;
Increments TBLPTR
TLRD
1, INDF0
; Read HI byte
;
of TABLATH
TABLRD
0, 1, INDF0
; Read LO byte
;
of TABLATL and
;
Update TABLATH
;
Increment TBLPTR
Q1 Q2
Q3
Q4
Q1 Q2
Q3
Q4 Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4
AD15:AD0
Instruction
Fetched
Instruction
Executed
ALE
OE
WR
TABLRD
INST (PC+1)
INST (PC+2)
INST (PC-1)
TABLRD cycle1
TABLRD cycle2
INST (PC+1)
Data read cycle
PC
PC+1
TBL
Data in
PC+2
’1’
Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4
Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4 Q1 Q2 Q3 Q4
AD15:AD0
Instruction
Fetched
Instruction
Executed
TABLRD1
TABLRD2
INST (PC+2)
INST (PC+3)
INST (PC+2)
ALE
OE
WR
INST (PC-1)
TABLRD1 cycle1 TABLRD1 cycle2 TABLRD2 cycle1 TABLRD2 cycle2
Data read cycle
’1’
PC
PC+1
PC+2
PC+3
TBL1 Data in 1
TBL2
Data in 2
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