參數(shù)資料
型號(hào)： PIC18F4539-I/ML
廠商： Microchip Technology
文件頁數(shù)： 302/322頁
文件大?。?/td> 0K
描述： IC MCU FLASH 12KX16 EE A/D 44QFN
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
標(biāo)準(zhǔn)包裝： 45
系列： PIC® 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 40MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 32
程序存儲(chǔ)器容量： 24KB（12K x 16）
程序存儲(chǔ)器類型： 閃存
EEPROM 大小： 256 x 8
RAM 容量： 1408 x 8
電壓 - 電源 (Vcc/Vdd)： 4.2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-VQFN 裸露焊盤
包裝： 管件
配用： 444-1001-ND - DEMO BOARD FOR PICMICRO MCU
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PIC18FXX39
DS30485A-page 78
Preliminary
2002 Microchip Technology Inc.
8.4
IPR Registers
The IPR registers contain the individual priority bits for
the peripheral interrupts. Due to the number of periph-
eral interrupt sources, there are two Peripheral Inter-
rupt Priority registers (IPR1, IPR2). The operation of
the priority bits requires that the Interrupt Priority
Enable (IPEN) bit be set.
For PIC18FXX39 devices, the Motor Control kernel
requires that the Timer2 to PR2 match interrupt be the
only high priority interrupt. Failure to do this may result
in unpredictable operation of the kernel or the entire
microcontroller.
In practical terms, this means:
Interrupt priority levels are enabled (IPEN = 1);
High priority interrupts are enabled
(INTCON<7> = 1);
Timer2 interrupt is enabled and set as high priority
(PIE1<1> and IPR<1> = 1); and
all other interrupts are disabled (INTCON or PIR
bits = 0), or set as low priority (IPR bits = 0).
REGISTER 8-8:
IPR1: PERIPHERAL INTERRUPT PRIORITY REGISTER 1
Note:
Configuring the interrupts is automatically
done
by
the
API
method
void
ProMPT_Init(PWMfrequency
). It is the
user’s responsibility to make certain that
this method is called at the very beginning
of the application.
R/W-1
U-1
R/W-1
PSPIP(1,2)
ADIP(2)
RCIP(2)
TXIP(2)
SSPIP(2)
—TMR2IP(3) TMR1IP(2)
bit 7
bit 0
bit 7
PSPIP(1,2): Parallel Slave Port Read/Write Interrupt Priority bit
1
= High priority
0
= Low priority
bit 6
ADIP(2): A/D Converter Interrupt Priority bit
1
= High priority
0
= Low priority
bit 5
RCIP(2): USART Receive Interrupt Priority bit
1
= High priority
0
= Low priority
bit 4
TXIP(2): USART Transmit Interrupt Priority bit
1
= High priority
0
= Low priority
bit 3
SSPIP(2): Master Synchronous Serial Port Interrupt Priority bit
1
= High priority
0
= Low priority
bit 2
Unimplemented: Read as ‘1’
bit 1
TMR2IP(3): TMR2 to PR2 Match Interrupt Priority bit
1
= High priority
0
= Low priority
bit 0
TMR1IP(2): TMR1 Overflow Interrupt Priority bit
1
= High priority
0
= Low priority
Note 1: This bit is reserved on PIC18F2X39 devices.
2: Maintain this bit cleared (= 0).
3: This bit is reserved for use by the ProMPT kernel; always maintain this bit set (= 1).
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
- n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
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