參數(shù)資料
型號： PIC18F46J50T-I/ML
廠商： Microchip Technology
文件頁數(shù)： 31/164頁
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 64KB 44-QFN
產(chǎn)品培訓模塊： PIC18 J Series MCU Overview
PIC18F MPLAB® Starter Kit
標準包裝： 1,600
系列： PIC® XLP™ 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 48MHz
連通性： I²C，SPI，UART/USART，USB
外圍設備： 欠壓檢測/復位，DMA，POR，PWM，WDT
輸入/輸出數(shù)： 34
程序存儲器容量： 64KB（32K x 16）
程序存儲器類型： 閃存
RAM 容量： 3.8K x 8
電壓 - 電源 (Vcc/Vdd)： 2.15 V ~ 3.6 V
數(shù)據(jù)轉換器： A/D 13x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 44-VQFN 裸露焊盤
包裝： 帶卷 (TR)
PIC18F46J50 FAMILY
DS39931D-page 126
2011 Microchip Technology Inc.
9.4
IPR Registers
The IPR registers contain the individual priority bits for
the peripheral interrupts. Due to the number of
peripheral interrupt sources, there are three Peripheral
Interrupt Priority registers (IPR1, IPR2, IPR3). Using
the priority bits requires that the Interrupt Priority
Enable (IPEN) bit be set.
REGISTER 9-10:
IPR1: PERIPHERAL INTERRUPT PRIORITY REGISTER 1 (ACCESS F9Fh)
R/W-1
PMPIP(1)
ADIP
RC1IP
TX1IP
SSP1IP
CCP1IP
TMR2IP
TMR1IP
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 7
PMPIP:
Parallel Master Port Read/Write Interrupt Priority bit(1)
1
=High priority
0
= Low priority
bit 6
ADIP:
A/D Converter Interrupt Priority bit
1
=High priority
0
= Low priority
bit 5
RC1IP:
EUSART1 Receive Interrupt Priority bit
1
=High priority
0
= Low priority
bit 4
TX1IP:
EUSART1 Transmit Interrupt Priority bit
1
=High priority
0
= Low priority
bit 3
SSP1IP:
Master Synchronous Serial Port Interrupt Priority bit (MSSP1 module)
1
=High priority
0
= Low priority
bit 2
CCP1IP:
ECCP1 Interrupt Priority bit
1
=High priority
0
= Low priority
bit 1
TMR2IP:
TMR2 to PR2 Match Interrupt Priority bit
1
=High priority
0
= Low priority
bit 0
TMR1IP:
TMR1 Overflow Interrupt Priority bit
1
=High priority
0
= Low priority
Note 1:
These bits are unimplemented on 28-pin devices.
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PDF描述
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