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參數(shù)資料
| 型號(hào)： | PIC18F8310 |
| 廠商： | Microchip Technology Inc. |
| 英文描述： | 64/80-Pin Flash Microcontrollers with nanoWatt Technology |
| 中文描述： | 64/80-Pin閃存微控制器與納瓦技術(shù) |
| 文件頁(yè)數(shù)： | 41/404頁(yè) |
| 文件大小： | 3268K |
| 代理商： | PIC18F8310 |
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2004 Microchip Technology Inc.
Preliminary
DS39635A-page 39
PIC18F6310/6410/8310/8410
3.0
POWER MANAGED MODES
PIC18F6310/6410/8310/8410 devices offer a total of
seven operating modes for more efficient power
management. These modes provide a variety of
options for selective power conservation in applications
where resources may be limited (i.e., battery-powered
devices).
There are three categories of power managed modes:
Sleep mode
Idle modes
Run modes
These categories define which portions of the device
are clocked and sometimes, what speed. The Run and
Idle modes may use any of the three available clock
sources (primary, secondary or INTOSC multiplexer);
the Sleep mode does not use a clock source.
The
power
managed
power-saving features. One of these is the clock
switching feature, offered in other PIC18 devices,
allowing the controller to use the Timer1 oscillator in
place of the primary oscillator. Also included is the
Sleep mode, offered by all PICmicro
devices, where
all device clocks are stopped.
modes
include
several
3.1
Selecting Power Managed Modes
Selecting a power managed mode requires deciding if
the CPU is to be clocked or not and selecting a clock
source. The IDLEN bit controls CPU clocking, while the
SCS1:SCS0 bits select a clock source. The individual
modes, bit settings, clock sources and affected
modules are summarized in Table 3-1.
3.1.1
CLOCK SOURCES
The SCS1:SCS0 bits allow the selection of one of three
clock sources for power managed modes. They are:
the primary clock, as defined by the
FOSC3:FOSC0 configuration bits
the secondary clock (the Timer1 oscillator)
the internal oscillator block (for RC modes)
3.1.2
ENTERING POWER MANAGED
MODES
Entering Power Managed Run mode, or switching from
one power managed mode to another, begins by
loading the OSCCON register. The SCS1:SCS0 bits
select the clock source and determine which Run or
Idle mode is being used. Changing these bits causes
an immediate switch to the new clock source,
assuming that it is running. The switch may also be
subject to clock transition delays. These are discussed
in
Section 3.1.3 “Clock Transitions and Status
Indicators”
and subsequent sections.
Entry to the Power Managed Idle or Sleep modes is
triggered by the execution of a
SLEEP
instruction. The
actual mode that results depends on the status of the
IDLEN bit.
Depending on the current mode and the mode being
switched to, a change to a power managed mode does
not always require setting all of these bits. Many transi-
tions may be done by changing the oscillator select
bits, or changing the IDLEN bit prior to issuing a
SLEEP
instruction. If the IDLEN bit is already configured
correctly, it may only be necessary to perform a
SLEEP
instruction to switch to the desired mode.
TABLE 3-1:
POWER MANAGED MODES
Mode
OSCCON bits
Module Clocking
Available Clock and Oscillator Source
IDLEN
(1)
<7>
SCS1:SCS0
<1:0>
CPU
Peripherals
Sleep
PRI_RUN
0
N/A
Off
Off
None – All clocks are disabled
Primary – LP, XT, HS, HSPLL, RC, EC, INTRC
(2)
This is the normal full power execution mode.
Secondary – Timer1 Oscillator
Internal Oscillator Block
(2)
Primary – LP, XT, HS, HSPLL, RC, EC
Secondary – Timer1 Oscillator
Internal Oscillator Block
(2)
N/A
00
Clocked
Clocked
SEC_RUN
RC_RUN
PRI_IDLE
SEC_IDLE
RC_IDLE
Note 1:
N/A
N/A
01
Clocked
Clocked
Off
Off
Off
Clocked
Clocked
Clocked
Clocked
Clocked
1x
1
1
00
01
1
1x
IDLEN reflects its value when the
SLEEP
instruction is executed.
Includes INTOSC and INTOSC postscaler, as well as the INTRC source.
2:
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