參數(shù)資料
型號(hào)： PIC18LF1230-I/ML
廠商： Microchip Technology
文件頁(yè)數(shù)： 37/318頁(yè)
文件大?。?/td> 0K
描述： IC PIC MCU FLASH 2KX16 28QFN
產(chǎn)品培訓(xùn)模塊： Asynchronous Stimulus
8-bit PIC® Microcontroller Portfolio
標(biāo)準(zhǔn)包裝： 61
系列： PIC® 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 40MHz
連通性： UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 16
程序存儲(chǔ)器容量： 4KB（2K x 16）
程序存儲(chǔ)器類型： 閃存
EEPROM 大?。?/td> 128 x 8
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 2 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 28-VQFN 裸露焊盤
包裝： 管件
產(chǎn)品目錄頁(yè)面： 641 (CN2011-ZH PDF)
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PIC18F1230/1330
2009 Microchip Technology Inc.
DS39758D-page 131
14.6
PWM Duty Cycle
PWM duty cycle is defined by the PDCx (PDCxL and
PDCxH) registers. There are a total of three PWM Duty
Cycle registers for four pairs of PWM channels. The
Duty Cycle registers have 14-bit resolution by combin-
ing the six LSbs of PDCxH with the 8 bits of PDCxL.
PDCx is a double-buffered register used to set the
counting period for the PWM time base.
14.6.1
PWM DUTY CYCLE REGISTERS
There are three 14-bit Special Function Registers used
to specify duty cycle values for the PWM module:
PDC0 (PDC0L and PDC0H)
PDC1 (PDC1L and PDC1H)
PDC2 (PDC2L and PDC2H)
The value in each Duty Cycle register determines the
amount of time that the PWM output is in the active
state. The upper 12 bits of PDCx hold the actual duty
cycle value from PTMRH/L<11:0>, while the lower two
bits control which internal Q clock the duty cycle match
will occur. This 2-bit value is decoded from the Q
clocks, as shown in Figure 14-11, when the prescaler is
1:1 (PTCKPS<1:0> = 00).
In Edge-Aligned mode, the PWM period starts at Q1 and
ends when the Duty Cycle register matches the PTMR
register as follows. The duty cycle match is considered
when the upper 12 bits of the PDCx are equal to the
PTMR and the lower 2 bits are equal to Q1, Q2, Q3 or
Q4, depending on the lower two bits of the PDCx (when
the prescaler is 1:1 or PTCKPS<1:0> = 00)
.
Each compare unit has logic that allows override of the
PWM signals. This logic also ensures that the PWM
signals will complement each other (with dead-time
insertion) in Complementary mode (see Section 14.7
).
FIGURE 14-11:
DUTY CYCLE COMPARISON
Note:
When
the
prescaler
is
not
1:1
(PTCKPS<1:0>
~00), the duty cycle
match occurs at the Q1 clock of the
instruction cycle when the PTMR and
PDCx match occurs.
Note:
To get the correct PWM duty cycle, always
multiply the calculated PWM duty cycle
value by four before writing it to the PWM
Duty Cycle registers. This is due to the two
additional LSBs in the PWM Duty Cycle
registers which are compared against the
internal Q clock for the PWM duty cycle
match.
PTMR<11:0>
PDCx<13:0>
Comparator
Unused
PTMRH<7:0>
PTMRL<7:0>
PTMRH<3:0>
PTMRL<7:0>
Q Clocks(1)
PDCxH<7:0>
PDCxL<7:0>
PDCxH<5:0>
PDCxL<7:0>
<1:0>
Note 1:
This value is decoded from the Q clocks:
00
= duty cycle match occurs on Q1
01
= duty cycle match occurs on Q2
10
= duty cycle match occurs on Q3
11
= duty cycle match occurs on Q4
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PIC18LF1320-I/SOG 功能描述:8位微控制器 -MCU 8kBF 256RM 16I/O Lead Free Package RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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